參數(shù)資料
型號(hào)： KSZ8851SNLI TR
廠商： Micrel Inc
文件頁數(shù)： 17/80頁
文件大?。?/td> 0K
描述： IC ETHERNET CTLR 1PORT PCI 32MLF
標(biāo)準(zhǔn)包裝： 1
控制器類型： 以太網(wǎng)控制器，MAC/PHY
接口： 總線
電源電壓： 1.8V，2.5V，3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，32-MLF?
供應(yīng)商設(shè)備封裝： 32-MLF?（5x5）
包裝： 標(biāo)準(zhǔn)包裝
產(chǎn)品目錄頁面： 1081 (CN2011-ZH PDF)
其它名稱： 576-3506-6
Micrel, Inc.
KSZ8851SNL/SNLI
August 2009
24
M9999-083109-2.0
0 contains only opcode (10: read command, 11: write command) and the following is read/write data phase.
Figure 9. RXQ FIFO Read Timing
Figure 10. TXQ FIFO Write Timing
Queue Management Unit (QMU)
The Queue Management Unit (QMU) manages packet traffic between the MAC/PHY interface and the system host. It has
built-in packet memory for receive and transmit functions called TXQ (Transmit Queue) and RXQ (Receive Queue). Each
queue contains 12KB for RXQ and 6KB for TXQ of memory with back-to-back, non-blocking frame transfer performance.
It provides a group of control registers for system control, frame status registers for current packet transmit/receive status,
and interrupts to inform the host of the real time TX/RX status.
Transmit Queue (TXQ) Frame Format
The frame format for the transmit queue is shown in the following Table 6. The first word contains the control information
SO
SCLK
SI
CSN
1
0
XXXXXX
XX
XXXXX
X
D7
D6
D5
D4
D3
D2
D1
D0
RXQ Read Command Byte 0
Read Data Byte 1
Read Data Byte 2
XXXXXXXX
XXX
XXXX
X
Read Data Byte 3
Read Data Byte 4
Read Data Byte N
X
XXXXXXXX
D7
D6
D5
D4
D3
D2
D1
D0
D7
D6
D5
D4
D3
D2
D1
D0
D7
D6
D5
D4
D3
D2
D1
D0
SO
SCLK
SI
CSN
D7
D6
D5
D4
D3
D2
D1
D0
High Impedance
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PDF描述
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參數(shù)描述
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