參數(shù)資料
型號(hào): LAMXO640E-3TN144E
廠商: Lattice Semiconductor Corporation
文件頁數(shù): 33/77頁
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描述: IC FPGA 640LUTS 144TQFP
標(biāo)準(zhǔn)包裝: 60
系列: LA-MachXO
可編程類型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 4.9ns
電壓電源 - 內(nèi)部: 1.14 V ~ 1.26 V
宏單元數(shù): 320
輸入/輸出數(shù): 113
工作溫度: -40°C ~ 125°C
安裝類型: 表面貼裝
封裝/外殼: 144-LQFP
供應(yīng)商設(shè)備封裝: 144-TQFP(20x20)
包裝: 托盤
3-13
DC and Switching Characteristics
Lattice Semiconductor
LA-MachXO Automotive Family Data Sheet
LA-MachXO External Switching Characteristics
1
Over Recommended Operating Conditions
Parameter
Description
Device
-3
Units
Min.
Max.
General I/O Pin Parameters (Using Global Clock without PLL)
1
tPD
Best Case tPD Through 1 LUT
LCMXO256
4.9
ns
LCMXO640
4.9
ns
LCMXO1200
5.1
ns
LCMXO2280
5.1
ns
tCO
Best Case Clock to Output - From PFU
LCMXO256
5.6
ns
LCMXO640
5.7
ns
LCMXO1200
6.1
ns
LCMXO2280
6.1
ns
tSU
Clock to Data Setup - To PFU
LCMXO256
1.8
ns
LCMXO640
1.5
ns
LCMXO1200
1.6
ns
LCMXO2280
1.5
ns
tH
Clock to Data Hold - To PFU
LCMXO256
-0.3
ns
LCMXO640
-0.1
ns
LCMXO1200
0.0
ns
LCMXO2280
-0.4
ns
fMAX_IO
Clock Frequency of I/O and PFU Register
LCMXO256
500
MHz
LCMXO640
500
MHz
LCMXO1200
500
MHz
LCMXO2280
500
MHz
tSKEW_PRI
Global Clock Skew Across Device
LCMXO256
240
ps
LCMXO640
240
ps
LCMXO1200
260
ps
LCMXO2280
260
ps
1. General timing numbers based on LVCMOS2.5V, 12 mA.
Rev. A 0.19
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PDF描述
LAMXO640C-3TN144E IC FPGA AUTO 640LUTS 144TQFP
VE-JWW-CW-B1 CONVERTER MOD DC/DC 5.5V 100W
TAP105M050CRW CAP TANT 1UF 50V 20% RADIAL
HCC49DREI-S93 CONN EDGECARD 98POS .100 EYELET
MAX1806EUA33/V+ IC REG LDO 3.3V/ADJ .5A 8UMAX
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