參數(shù)資料
型號： MCIMX514AJM6C
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： SPECIALTY MICROPROCESSOR CIRCUIT, PBGA529
封裝： 19 X 19 MM, 0.8 MM PITCH, ROHS COMPLIANT, BGA-529
文件頁數(shù)： 130/172頁
文件大?。?/td> 2218K
代理商： MCIMX514AJM6C
i.MX51A Automotive and Infotainment Applications Processors, Rev. 4
60
Freescale Semiconductor
Electrical Characteristics
WE43 Input Data Valid to CSx_B
Invalid
MAXCO + MAXDI
MAXCO6 + MAXDI7
—ns
WE44 CSx_B Invalid to Input Data
invalid
00
—
ns
WE45 CSx_B Valid to BEy_B Valid
(Write access)
WE12 – WE6 + (WBEA – CSA)
—
3 + (WBEA – CSA)
ns
WE46 BEy_B Invalid to CSx_B Invalid
(Write access)
WE7 – WE13 + (WBEN – CSN)
—
–3 + (WBEN – CSN)
ns
WE47 Dtack Valid to CSx_B Invalid
MAXCO + MAXDTI
MAXCO6 + MAXDTI8
—ns
WE48 CSx_B Invalid to Dtack invalid
0
—
ns
1 Parameters WE4... WE21 value see in the Table 54.
2 CS Assertion. This bit field determines when CS signal is asserted during read/write cycles.
3 CS Negation. This bit field determines when CS signal is negated during read/write cycles.
4 BE Assertion. This bit field determines when BE signal is asserted during read cycles.
5 BE Negation. This bit field determines when BE signal is negated during read cycles.
6 Output maximum delay from internal driving the FFs to chip outputs. The Max. delay between all memory controls (addr,
csx_b, oe_b, we_b, bey_b, and adv_b)
7 Maximum delay from chip input data to internal FFs. The max. delay between all data input pins.
8 DTACK maximum delay from chip input data to internal FF.
Table 54. WEIM Asynchronous Timing Parameters Table Relative Chip Select (continued)
ID
Parameter
Determination by
Synchronous Measured
Parameters 1
Min
Max
Unit
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PDF描述
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