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參數(shù)資料
| 型號： | MR80C32-12:D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 12 MHz, MICROCONTROLLER, CQCC44 |
| 封裝： | LCC-44 |
| 文件頁數(shù)： | 22/336頁 |
| 文件大?。?/td> | 8801K |
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118
ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
Table 15-3 shows the COMnx1:0 bit functionality when the WGMn3:0 bits are set to the fast PWM mode.
Note:
1. A special case occurs when OCRnA/OCRnB equals TOP and COMnA1/COMnB1 is set. In this case the compare
match is ignored, but the set or clear is done at TOP. See “Fast PWM mode” on page 110 for more details.
Table 15-4 shows the COMnx1:0 bit functionality when the WGMn3:0 bits are set to the phase correct or the phase
and frequency correct, PWM mode.
Note:
1. A special case occurs when OCRnA/OCRnB equals TOP and COMnA1/COMnB1 is set. See “Phase correct PWM
mode” on page 111 for more details.
Bit 1:0 – WGMn1:0: Waveform Generating mode
Combined with the WGMn3:2 bits found in the TCCRnB Register, these bits control the counting sequence of the
counter, the source for maximum (TOP) counter value, and what type of waveform generating to be used, see
Table 15-5 on page 119. Modes of operation supported by the Timer/Counter unit are: Normal mode (counter),
Clear Timer on Compare match (CTC) mode, and three types of Pulse Width Modulation (PWM) modes. See “16-
Table 15-3.
Compare Output mode, fast PWM
(1).
COMnA1/COMnB1
COMnA0/COMnB0
Description
0
Normal port operation, OCnA/OCnB disconnected
01
WGMn3:0 = 14 or 15: Toggle OC1A on Compare
Match, OC1B disconnected (normal port operation).
For all other WGM1 settings, normal port operation,
OC1A/OC1B disconnected
10
Clear OCnA/OCnB on Compare Match, set
OCnA/OCnB at TOP
11
Set OCnA/OCnB on Compare Match, clear
OCnA/OCnB at TOP
Table 15-4.
Compare Output mode, phase correct and phase and frequency correct PWM
COMnA1/COMnB1
COMnA0/COMnB0
Description
0
Normal port operation, OCnA/OCnB disconnected
01
WGMn3:0 = 8, 9 10 or 11: Toggle OCnA on Compare
Match, OCnB disconnected (normal port operation).
For all other WGM1 settings, normal port operation,
OC1A/OC1B disconnected
10
Clear OCnA/OCnB on Compare Match when up-
counting. Set OCnA/OCnB on Compare Match when
downcounting
11
Set OCnA/OCnB on Compare Match when up-
counting. Clear OCnA/OCnB on Compare Match
when downcounting
相關PDF資料 |
PDF描述 |
|---|---|
| MR80C32E-36:D | 8-BIT, 36 MHz, MICROCONTROLLER, CQCC44 |
| MR80C52TXXX-16SHXXX:R | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| MQ80C32E-20:R | 8-BIT, 20 MHz, MICROCONTROLLER, CQFP44 |
| MQ80C52CXXX-16:RD | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQFP44 |
| MF280C51C-25R | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, PQFP44 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MR80C32-16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MR80C32-20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MR80C32-25 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MR80C32-30 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| MR80C32-36 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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