參數(shù)資料
型號： PCI4515ZHK
廠商： Texas Instruments, Inc.
英文描述： SINGLE SOCKET CARDBUS CONTROLLER WITH INTEGRATED
中文描述： 單插槽CardBus控制器，它集成
文件頁數(shù)： 35/216頁
文件大?。?/td> 1138K
代理商： PCI4515ZHK
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217
Table 213. CardBus PC Card Address and Data Terminals
TERMINAL
I/O
DESCRIPTION
NAME
NUMBER
A_CAD31
A_CAD30
A_CAD29
A_CAD28
A_CAD27
A_CAD26
A_CAD25
A_CAD24
A_CAD23
A_CAD22
A_CAD21
A_CAD20
A_CAD19
A_CAD18
A_CAD17
A_CAD16
A_CAD15
A_CAD14
A_CAD13
A_CAD12
A_CAD11
A_CAD10
A_CAD9
A_CAD8
A_CAD7
A_CAD6
A_CAD5
A_CAD4
A_CAD3
A_CAD2
A_CAD1
A_CAD0
C10
A10
F11
E11
C11
B13
C13
A14
B14
B15
E14
A16
D19
E17
F15
H19
J17
J15
J18
K15
K17
K18
L15
L18
L19
M17
M18
N19
M15
N17
N18
P19
I/O
CardBus address and data. These signals make up the multiplexed CardBus address and data bus on the
CardBus interface. During the address phase of a CardBus cycle, CAD31CAD0 contain a 32-bit address.
During the data phase of a CardBus cycle, CAD31CAD0 contain data. CAD31 is the most significant bit.
A_CC/BE3
A_CC/BE2
A_CC/BE1
A_CC/BE0
E13
E18
H18
L17
I/O
CardBus bus commands and byte enables. CC/BE3CC/BE0 are multiplexed on the same CardBus
terminals. During the address phase of a CardBus cycle, CC/BE3CC/BE0 define the bus command. During
the data phase, this 4-bit bus is used as byte enables. The byte enables determine which byte paths of the
full 32-bit data bus carry meaningful data. CC/BE0 applies to byte 0 (CAD7CAD0), CC/BE1 applies to
byte 1 (CAD15CAD8), CC/BE2 applies to byte 2 (CAD23CAD16), and CC/BE3 applies to byte 3
(CAD31CAD24).
A_CPAR
H14
I/O
CardBus parity. In all CardBus read and write cycles, the controller calculates even parity across the CAD
and CC/BE buses. As an initiator during CardBus cycles, the controller outputs CPAR with a one-CCLK
delay. As a target during CardBus cycles, the controller compares its calculated parity to the parity indicator
of the initiator; a compare error results in a parity error assertion.
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