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參數(shù)資料
| 型號： | PEB22554 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 192/397頁 |
| 文件大小： | 1987K |
| 代理商： | PEB22554 |
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Semiconductor Group
192
09.98
PEB 22554
General Features T1
115, 138,
43, 66
RL1(1-4)
RDIP(1-4)
ROID(1-4)
I
I
I
Line Receiver 1
Analog Input from the external transformer.
Selected if LIM1.DRS = 0.
Receive Data Input Positive
Digital input for received dual rail PCM(+) route
signal which will be latched with the internal
generated Receive Route Clock. An internal DPLL
will extract the Receive Route Clock from the
incoming data pulse. The duty cycle of the
receiving signal has to be closely to 50 %.
The Dual Rail mode is selected if LIM1.DRS = 1
and FMR0.RC1 = 1. Input sense is selected by bit
RC0.RDIS (after Reset: active low).
Receive Optical Interface Data
Unipolar data received from fibre optical interface
with 1.544 MBit/s. Latching of data is done with
the falling edge of RCLKI. Input sense is selected
by bit RC0.RDIS.
The Single Rail mode is selected if LIM1.DRS = 1
and FMR0.RC1 = 0.
Line Receiver
2
Analog Input from the external transformer.
Selected if LIM1.DRS = 0.
Receive Data Input Negative
Input for received dual rail PCM(-) route signal
which will be latched with the internal generated
Receive Route Clock. An internal DPLL will
extract the Receive Route Clock from the
incoming data pulse. The duty cycle of the
receiving signal has to be closely to 50 %.
The dual rail mode is selected if LIM1.DRS = 1
and FMR0.RC1 = 1. Input sense is selected by bit
RC0.RDIS (after Reset: active low).
Receive Clock Input
Receive clock input for the optical interface if
LIM1.DRS = 1 and FMR0.RC1/0 = 00.
Clock frequency: 1544 kHz
116, 137,
44, 65
RL2(1-4)
RDIN(1-4)
RCLKI(1-4)
I
I
I
Pin Definitions and Function
(cont’d)
Pin No.
Symbol
Input (I)
Output (O)
Function
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PDF描述 |
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參數(shù)描述 |
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