參數(shù)資料
型號: PSB7238
廠商: SIEMENS A G
元件分類: 編解碼器
英文描述: Joint Audio Decoder-Encoder - Multimode
中文描述: A/MU-LAW, PCM CODEC, PQFP100
文件頁數(shù): 127/190頁
文件大?。?/td> 2255K
代理商: PSB7238
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PSB 7238
Register Description
Semiconductor Group
127
Data Sheet 1998-07-01
A ‘0’ in a bit position (status after reset) masks the corresponding bit in ISR.
1)
“Hunt Mode”: The HDLC-receiver hunts for flags which are not followed by another flag or an abort sequence.
Thus, the HDLC-receiver of the JADE will receive two frames correctly if they are separated by only one
common flag (shared flag). It will also receive two frames correctly if they are separated by two flags
(back-to-back frames). In case of a back-to-back frame the flags may share the ‘0’ or not.
XPR
Transmit Pool Ready
One data block may be entered into the transmit FIFO.
Set:
After XF command has been executed and after XRES.
Reset: After ISR is read, after hardware reset.
Transmit Data Underrun
Transmitted frame was terminated with an abort sequence because no data
was available in the transmit FIFO and yet no XME command has been
issued.
In transparent mode indicates the transmission has been stopped because
no data was available in the transmit FIFO.
Set:
When the HDLC bitengine requests new data from an empty XFIFO.
Reset: After ISR is read, after XRES, after hardware reset.
All Sent
When ‘1’, indicates that the last bit of a frame has been transmitted on the
line and that both XFIFO parts are empty (in either HDLC or transparent
mode).
Set:
When the last bit of a frame has been transmitted to the line.
Reset: After ISR is read, after XRES, after hardware reset.
All ISR bits are acknowledged when ISR is read.
XDU
ALLS
Interrupt Mask Register
IMR
Write
Address 2C
H
Bit 7
RME
Bit 0
IMR
RPF
RFO
XPR
XDU
ALLS
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PDF描述
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