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參數(shù)資料
| 型號： | PSB7238 |
| 廠商： | SIEMENS A G |
| 元件分類： | 編解碼器 |
| 英文描述： | Joint Audio Decoder-Encoder - Multimode |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP100 |
| 文件頁數(shù)： | 53/190頁 |
| 文件大?。?/td> | 2255K |
| 代理商： | PSB7238 |
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PSB 7238
Functional Blocks
Semiconductor Group
53
Data Sheet 1998-07-01
*
Figure 22
Caption to the Figures
In receive direction, the input data is loaded from the shift register into DSP accessible
read registers and simultaneously into (physically separate) host accessible read
registers.
In the transmit direction, data is loaded into the shift register from the transmit channel
register accessible from the DSP (if HXA = 0) or the register accessible from the host (if
HXA = 1). Two separate control bits HXA1 and HXA2 are provided for this purpose, for
audio channel 1 and audio channel 2, respectively.
HDLC/Transparent Data Channel Transfer
The interface between the input of the HDLC/transparent data receiver and the DSP or
host, and between the output of the transmitter and DSP or host is in each case a 32-bit
long shift register.
Receiver in LMOD(1:0) = 01, 10, 11
In receive direction, when the shift register from the serial line is filled to a programmable
level (1, 2 or 4), the whole 32-bit shift register is loaded into the HRR1/2 read registers,
physically separate for DSP and host. In the same cycle the contents of the HRW1/2
write register accessible from the DSP (if HHR1/2 = 0) or host (HHR1/2 = 1) are loaded
to the HDLC receiver input. In the next cycle the data from HRR1/2 is as a default loaded
into HRW1/2 and a maskable interrupt status BFHR1/2 is generated to the DSP and
host. The interrupt status is generated to both DSP and host, independent of the setting
of HAH1/2. If the data in HRR1/2 is to be pre-processed, the HRW1/2 register can be
overwritten by the DSP or host before the next 1, 2 or 4 bytes (programmable) have been
shifted into the shift register.
M
U
X
10
DU
0x
11
SLIN
Time-slot
Count
Logic
Shift Register
1 to 32 bits (LBIT)
2
SLIN
2
M
U
X
01
00
11
DD
SR
ST
10
LMOD
BEMP
5
LBIT
Transmit 1,2:
Strobe
EN*Strobe
FSC
DCL(/2)
RFS
SCLK
TFS
SCLK
Load*
Time-slot
Parameters
TS-Clock
Enable
32 bits
Host/DSP
XCx
相關PDF資料 |
PDF描述 |
|---|---|
| PSB7280 | Joint Audio Decoder-Encoder |
| PSB8510-1P | Programmable Dialing Circuit |
| PSB8510-1T | Programmable Dialing Circuit |
| PSB8510-6P | Programmable Dialing Circuit |
| PSB8510-6T | Programmable Dialing Circuit |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PSB7238FV2.1JADEMM | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PSB7280 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:Joint Audio Decoder-Encoder |
| PSB7280FV3.1 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PSB7280FV3.1D | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PSB7300AGDW | 制造商:Infineon Technologies AG 功能描述: |
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