- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄368232 > PSD813F (意法半導(dǎo)體) Flash In-System-Programmable Microcontroller Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) PDF資料下載
參數(shù)資料
| 型號： | PSD813F |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash In-System-Programmable Microcontroller Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) |
| 中文描述： | Flash在系統(tǒng)可編程微控制器外圍設(shè)備（閃速，在系統(tǒng)可編程微控制器外圍器件，100萬位閃速存儲器，256K位的EEPROM，16K的位的SRAM） |
| 文件頁數(shù)： | 97/130頁 |
| 文件大小： | 650K |
| 代理商： | PSD813F |
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Preliminary
PSD813F Family
93
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
t
NLNH
Warm RESET Active Low Time (Note 1)
150
ns
t
OPR
RESET High to Operational Device
120
ns
t
NLNH-PO
Power On Reset Active Low Time
(Note 2)
1
ms
Reset Timing
(5 V ± 10%)
NOTE:
1. t
CLCL
is the CLKIN clock period.
Microcontroller Interface – PSD813F AC/DC Parameters
(5V ±10% Versions)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
t
BVBH
Vstby Detection to Vstbyon Output High
20
μs
t
BXBL
VstbyOff Detection to Vstbyon
Output Low
20
μs
V
stbyon
Timing
(5 V ± 10%)
-90
-12
-15
Symbol
Parameter
Conditions
Min
Max
Min
Max
Min
Max
Unit
t
LVDV
ALE Access Time from
Power Down
120
135
150
ns
Maximum Delay from
APD Enable to Internal
PDN Valid Signal
t
CLWH
Using CLKIN Input
15
*
t
CLCL
(Note 1)
μs
Power Down Timing
(5 V ± 10%)
NOTE:
1. RESET will not reset Flash or EEPROM programming/erase cycles.
2. tNLNH-PO is 10 ms for devices manufactured before rev. A.
相關(guān)PDF資料 |
PDF描述 |
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| PSD813FN | Field Programmble Microcontroller Peripherals(帶閃存的現(xiàn)場可編程微控制器) |
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| PSD82 | Three Phase Rectifier Bridges |
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參數(shù)描述 |
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| PSD813F1-A-12JI | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
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