參數(shù)資料
型號(hào)： RIVA 128ZX
廠商： 意法半導(dǎo)體
英文描述： 128-Bit 3D Multimedia Accelerator(128位3D多媒體加速器)
中文描述： 128位3D多媒體加速器（128位三維多媒體加速器）
文件頁(yè)數(shù)： 39/85頁(yè)
文件大?。?/td> 608K
代理商： RIVA 128ZX
128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128ZX
39/85
Table 11.
SDRAM/SGRAM I/O timing parameters
Figure 37.
SDRAM/SGRAM random write cycles within a page
NOTE
1
Covers either successive writes to the active row in a given bank or to the active rows in different banks.
FBDQM
is active
(low).
Figure 38.
SDRAM/SGRAM write to read cycle
NOTE
1
A read latency of 2 is shown for illustration
Figure 39.
SDRAM/SGRAM read to precharge, read latency of two
NOTE
1
FBDQM
is active (low)
Symbol
t
HZ
t
DS
Parameter
Min.
Max.
Unit
Notes
Data out high impedance time
4
10
ns
Write data setup time
4
ns
write
write
write
write
data n
data a
data x
data m
bank, col n
bank, col a
bank, col x
bank, col m
FBCLKx
Command
FBA[10:0]
FBD[63:0]
write
bank,
col n
nop
read
bank,
col b
nop
nop
nop
write
data n
write
data n
read
data b
FBCLKx
Command
FBA[10:0]
FBD[63:0]
nop
active
bank(s)
bank,row
data n
t
RP
read
precharge
nop
bank, col n
FBCLKx
Command
FBA[10:0]
FBD[63:0]
相關(guān)PDF資料
PDF描述
RIVA128ZX 128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128 RIVA 128⑩ 128-BIT 3D MULTIMEDIA ACCELERATOR
RIX-0142-H FILTER IEC EINGANG ULTRA KOMPAKT 1A
RIX-0342-H FILTER IEC EINGANG ULTRA KOMPAKT 3A
RIX-0642-H FILTER IEC EINGANG ULTRA KOMPAKT 6A
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