參數(shù)資料
型號： RIVA 128ZX
廠商： 意法半導體
英文描述： 128-Bit 3D Multimedia Accelerator(128位3D多媒體加速器)
中文描述： 128位3D多媒體加速器（128位三維多媒體加速器）
文件頁數(shù)： 82/85頁
文件大?。?/td> 608K
代理商： RIVA 128ZX
128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128ZX
82/85
Byte offsets 0x4F - 0x4C
AGP Command Register (0x4F - 0x4C = CAP_PTR + 8)
0x4F
0x4E
0x4D
0x4C
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10
9
8
7
6
5
4
3
2
1
0
R
R
S
A
R
D
Bits
Function
R W I
31:24
This field is set to the minimum request depth of the target as reported in its
RQ field.
R W -
23:10
Reserved
R - 0
9
SBA_ENABLE enables sideband addressing when set. The RIVA128ZX does
not implement sideband addressing.
R - 0
8
AGP_ENABLE allows the RIVA128ZX to act as an AGP master and initiate
AGP operations. The target must be enabled before enabling the RIVA128ZX
0 = disabled
1 = AGP operations enabled
R W 0
7:3
Reserved
R - 0
2:0
The DATA_RATE field must be set to 0x01 to indicate 66MHz/1x transfer
mode or 0x02 for 133MHz/2x transfer mode. This value must also be set on
the target before being enabled. The initial value 0x00 indicates PCI opera-
tion.
R W 0x00
相關PDF資料
PDF描述
RIVA128ZX 128-BIT 3D MULTIMEDIA ACCELERATOR
RIVA128 RIVA 128⑩ 128-BIT 3D MULTIMEDIA ACCELERATOR
RIX-0142-H FILTER IEC EINGANG ULTRA KOMPAKT 1A
RIX-0342-H FILTER IEC EINGANG ULTRA KOMPAKT 3A
RIX-0642-H FILTER IEC EINGANG ULTRA KOMPAKT 6A
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