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參數(shù)資料
| 型號： | SC1100UFH-300 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | Geode⑩ Information Appliance On a Chip |
| 中文描述： | Geode⑩信息家電在一個芯片 |
| 文件頁數(shù)： | 241/348頁 |
| 文件大小： | 2063K |
| 代理商： | SC1100UFH-300 |
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Revision 1.1
241
www.national.com
G
Core Logic Module
(Continued)
Offset 29h
Audio Bus Master 1: Input from codec; 32-Bit; Left and Right Channels; Slots 3 and 4.
Audio Bus Master 1 SMI Status Register (RC)
Reset Value: 00h
7:2
1
Reserved.
Bus Master Error.
Indicates if hardware encountered a second EOP before software has cleared the first.
0: No.
1: Yes.
If hardware encounters a second EOP (end of page) before software has cleared the first, it causes the bus master to pause
until this register is read to clear the error.
End of Page.
Indicates if the bus master transferred data which is marked by EOP bit in the PRD table (bit 30).
0: No.
1: Yes.
0
Offset 2Ah-2Bh
Not Used
Offset 2Ch-2Fh
Audio Bus Master 1: Input from codec; 32-Bit; Left and Right Channels; Slots 3 and 4.
Audio Bus Master 1 PRD Table Address (R/W)
Reset Value: 00000000h
31:2
Pointer to the Physical Region Descriptor Table.
This bit field is a PRD table pointer for Audio Bus Master 1.
When written, this register points to the first entry in a PRD table. Once Audio Bus Master 1 is enabled (Command Register
bit 0 = 1), it loads the pointer and updates this register (by adding 08h) so that it points to the next PRD.
When read, this register points to the next PRD.
Reserved.
Must be set to 0.
The Physical Region Descriptor (PRD) table consists of one or more entries - each describing a memory region to or from
which data is to be transferred. Each entry consists of two DWORDs.
1:0
Note:
DWORD 0:
DWORD 1:
[31:0]
31
30
29
[28:16]
[15:0]
= Memory Region Physical Base Address
= End of Table Flag
= End of Page Flag
= Loop Flag (JMP)
= Reserved (0)
= Byte Count of the Region (Size)
Offset 30h
Audio Bus Master 2: Output to codec; 16-Bit; Slot 5.
Audio Bus Master 2 Command Register (R/W)
Reset Value: 00h
7:4
3
Reserved.
Must be set to 0. Must return 0 on reads.
Read or Write Control.
Sets the transfer direction of Audio Bus Master 2.
0: PCI reads are performed.
1: PCI writes are performed.
This bit must be set to 0 (read) and should not be changed when the bus master is active.
Reserved.
Must be set to 0. Must return 0 on reads.
Bus Master Control.
Controls the state of the Audio Bus Master 2.
0: Disable.
1: Enable.
Setting this bit to 1 enables the bus master to begin data transfers. When writing 0 to this bit, the bus master must be either
paused or reached EOT. Writing 0 to this bit while the bus master is operating results in unpredictable behavior (and may
crash the bus master state machine). The only recovery from this condition is a PCI reset.
2:1
0
Table 5-38. F3BAR0+Memory Offset: XpressAUDIO Configuration Registers (Continued)
Bit
Description
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