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參數(shù)資料
| 型號(hào)： | SPEAR-07-NC03 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PBGA180 |
| 封裝： | LEAD FREE, 12 X 12 MM, 1.70 MM HEIGHT, LFBGA-180 |
| 文件頁數(shù)： | 141/194頁 |
| 文件大?。?/td> | 1987K |
| 代理商： | SPEAR-07-NC03 |
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Obsolete
Product(s)
- Obsolete
Product(s)
Obsolete
Product(s)
- Obsolete
Product(s)
6 Blocks description
SPEAR-07-NC03
NXT_EN
: Next Descriptor Fetch Mode enable. Set to '1', this bit enables the next descriptor
fetch mechanism.
Whenever a DMA transfer is completed, if this field is set, a new DMA descriptor is fetched. If
this field is '0' then no descriptor is fetched and an interrupt is raised as normal.
Note:
when a descriptor is fetched TX_DMA_CTL is one of the registers updated.
CONT_EN
: Continuos Mode Enable. This bit enables the DMA to run in continuos mode. If set
the DMA runs indefinitely ignoring DMA_ XFERCOUNT.
Note "continuos mode" supersedes "next descriptor mode".
DMA_XFERCOUNT
: Block size (in bytes) of DMA, maximum 4 Kbytes. If DMA_XFERCOUNT
is set to '0', the DMA will transfer 4 Kbyte data.
6.2.4.14 Ethernet DMA, TX Base Address Register
Mnemonic
: TX_DMA_ADDR
Address
: 0x3000_3038
Default value:
0x0000_0000
DMA_ADDR
: Start address, 32 bit WORD ALIGNED, for master DMA transfer.
This register is read by the DMA SM only before starting the DMA operation and when the wrap
condition is met, so further updates of this register will have unpredictable effects on the
running DMA.
FIX_ADDR
: Disables incrementing of DMA_ADDR: this means that all the DMA data transfer
operation will be performed at the same AHB address, i.e. the DMA base address.
WRAP_EN
: Enables wrap of the DMA transfer address to DMA_ADDR when the memory
location, specified in ADDR_WRAP, is reached.
6.2.4.15 Ethernet DMA, TX Next Descriptor Address Register
Mnemonic:
TX_DMA_NXT
Address:
0x3000_303C
Default value:
0x0000_0000
DMA_DESCR_ADDR
: When the DMA next descriptor fetch is enabled, this register points to
the next descriptor starting address. The DMA descriptors are 32 bits, so the
DMA_DESCR_ADDR MUST be 32 bit aligned.
Bit
Field name
Access
31-02
DMA_ADDR
RW
01
FIX_ADDR
RW
00
WRAP_EN
RW
Bit
Field name
Access
31-02
DMA_DESCR_ADDR
RW
01
Reserved
RO
00
NPOL_EN
RW
相關(guān)PDF資料 |
PDF描述 |
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| SPL2Y81-2S | 808 nm, LASER DIODE |
| SPLC-35-FE-BX-CDFA | FIBER OPTIC TRANSCEIVER, 1260-1360nm, 125Mbps(Tx), 125Mbps(Rx), SURFACE MOUNT, LC CONNECTOR |
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參數(shù)描述 |
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| SPEAR-09-H042 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:SPEAr⑩ Head200, ARM 926, 200 K customizable eASIC⑩ gates, large IP portfolio SoC |
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