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參數(shù)資料
| 型號： | SPEAR-07-NC03 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PBGA180 |
| 封裝： | LEAD FREE, 12 X 12 MM, 1.70 MM HEIGHT, LFBGA-180 |
| 文件頁數(shù)： | 149/194頁 |
| 文件大?。?/td> | 1987K |
| 代理商： | SPEAR-07-NC03 |
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Obsolete
Product(s)
- Obsolete
Product(s)
Obsolete
Product(s)
- Obsolete
Product(s)
6 Blocks description
SPEAR-07-NC03
6.2.4.25 MII Address Register
Mnemonic
: MAC_ADDR
Address
: 0x3000_3414
Default value
: 0x0000_0000
The MII Address Register is used to control the Management cycles to the External PHY
Controller chip.
PHY_ADD
: Phy Address. These bits tell which of the 32 possible PHY devices are being
accessed
MII_REG
: MII Register. These bits select the desired MII register in the selected PHY device.
MII_WR
: MII Write. Setting this bit tells the PHY that this will be a write operation using the MII
data register. If this bit is not set, this will be a read operation, placing the data in the MII data
register.
MII_BUSY
: MII Busy. This bit should read a logic 0 before writing to the MII address and MII
data registers. This bit must also be set to 0 during write to the MII address register. During a
MII register access, this bit will be then set to signify that a read or write access is in progress.
The MII data register should be kept valid until the MAC clears this bit during a PHY write
operation. The MII data register is invalid until the MAC has cleared it during a PHY read
operation. The MII address register should not be written to until this bit is cleared.
6.2.4.26 MII Data Register
Mnemonic
: MAC_DATA
Address
: 0x3000_3418
Default value
: 0x0000_0000
The MII Data Register contains the data to be written to the PHY register specified in the MII
address register, or it contains the read data from the PHY register whose address is specified
in the MII address register.
MII_DATA
: This contains the 16-bit value read from the PHY after a MII read operation or the
16-bit data value to be written to the PHY before a MII write operation.
Bit
Field name
Access
31 - 16
Reserved
RO
15 – 11
PHY_ADD
RW
10 - 06
MII_REG
RW
05 - 02
Reserved
RO
01
MII_WR
RW
00
MII_BUSY
RW
Bit
Field name
Access
31 - 16
Reserved
RO
15 – 00
MII_DATA
RW
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPG-8650A60KHZ | CRYSTAL OSCILLATOR, CLOCK, 0.06 MHz, CMOS OUTPUT |
| SPL-45-GB-EBZ-CDA | FIBER OPTIC TRANSCEIVER, 1480-1500nm, 1250Mbps(Tx), 1250Mbps(Rx), SURFACE MOUNT, LC CONNECTOR |
| SPL2F85 | FIBER OPTIC LASER DIODE EMITTER, 840-860nm, PANEL MOUNT, TO-220, FC CONNECTOR |
| SPL2Y81-2S | 808 nm, LASER DIODE |
| SPLC-35-FE-BX-CDFA | FIBER OPTIC TRANSCEIVER, 1260-1360nm, 125Mbps(Tx), 125Mbps(Rx), SURFACE MOUNT, LC CONNECTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPEAR-09-B042 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:SPEAr㈢ BASIC ARM 926EJ-S core, customizable logic, large IP portfolio SoC |
| SPEAR-09-H022 | 制造商:STMicroelectronics 功能描述: |
| SPEAR-09-H022_06 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:SPEAr Head200 ARM 926, 200K customizable eASIC gates, large IP portfolio SoC |
| SPEAR-09-H042 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:SPEAr⑩ Head200, ARM 926, 200 K customizable eASIC⑩ gates, large IP portfolio SoC |
| SPEAR-09-H122 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:SPEAr⑩ Head600 |
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