參數(shù)資料
型號: ST7267R8T1L/XXX
廠商: STMICROELECTRONICS
元件分類: 微控制器/微處理器
英文描述: 16-BIT, MROM, 30 MHz, RISC MICROCONTROLLER, PQFP64
封裝: 10 X 10 MM, LEAD FREE, TQFP-64
文件頁數(shù): 56/189頁
文件大?。?/td> 1643K
代理商: ST7267R8T1L/XXX
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ST7267C8 ST7267R8
149/189
MSCI PARALLEL INTERFACE (Cont’d)
17.7 REED SOLOMON ENCODER
The Reed Solomon encoder is a hardware system
that computes error code correction parity sym-
bols from data sent (or received) by the parallel in-
terface. It allows the correction of 4 bytes in each
512-byte packet.
The RS encoder works with 10 bit symbols. The 2
most significant bits of the RS encoder input are
forced to 0 by hardware.
The generated code is made of eight 10-bit sym-
bols that can be read as five 16-bit words by the
MSCI core after the "parity symbols ready" flag is
set. If the parallel interface is used in 16-bit data
mode, the data word is split into two bytes that are
sent to the ECC generator. The order of the bytes
in the word for the ECC generator can be selected
with bit 2 of the PCR2 register (ECC Swap Bytes)
The redundant code in the output FIFO is replaced
each time a new set of parity symbols is available.
The output FIFO status can not be reset by MSCI
software, all five 16-bit words must be read in or-
der to make the FIFO point to the first word again.
Reading this register when the FIFO is not ready
does NOT freeze the MSCI CPU.
Figure 66. Reed Solomon encoder implementation (When RS encoder enable = 1)
Word 7
Word 6
Word 5
Word 4
Word 3
Word 2
Word 1
Word 0
COM. BUFFER (0 or 1)
word/byte
conversion
ECC swap bytes
RS encoder
Input or Output
mode
previous data word
received from I/Os
Output FIFO
8*10bit
(5*16-bit)
MSCI
16-
b
itBUS
Status flags
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PDF描述
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