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參數(shù)資料
| 型號： | ST7267R8T1L/XXX |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 30 MHz, RISC MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, LEAD FREE, TQFP-64 |
| 文件頁數(shù)： | 84/189頁 |
| 文件大?。?/td> | 1643K |
| 代理商： | ST7267R8T1L/XXX |
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ST7267C8 ST7267R8
174/189
18.9 CONTROL PIN CHARACTERISTICS
18.9.1 Asynchronous RESET Pin
TA = 0 to +55°C unless otherwise specified
Notes:
1. The user must ensure that the level on the RESET pin can go below the VIL max. level specified in Section 18.9.1.
Otherwise the reset will not be taken into account internally.
2. To guarantee the reset of the Device, a minimum pulse has to be applied to the RESET pin. All short pulses applied
on RESET pin with a duration below teh(RSTL) can be ignored. Not tested in production, guaranted by design.
3. The reset network protects the device against parasitic resets.
4. The user must ensure that external reset duration respect this timing to guarantee a correct start-up of the internal
regulator at power-up. Not tested in production, guaranted by design.
Figure 84.
Typical RON on RESET pin
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIL
Input low level voltage 1)
0.16xV
DD33
V
VIH
Input high level voltage
0.85xVDD33
Vhys
Schmitt trigger voltage hysteresis1)
450
mV
RON
Pull-up equivalent resistor
VDD33=3.3V
20
40
80
k
VDD33=2V
100
teh(RSTL) External reset pulse hold time 2)
2.5
s
tg(RSTL)
Filtered glitch duration 3)
200
ns
tew(RSTL) External reset pulse duration 4)
500
s
tiw(RSTL) Internal reset pulse duration
2
Tcpu
NRESET pullup (kOhms)
40
50
60
70
80
90
100
22.5
33.5
Vdd (V)
N
R
ES
ET
p
u
llu
p
(
k
O
h
m
s
)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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