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參數(shù)資料
| 型號： | TMX320DM6437BZWTA |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media Processor |
| 中文描述： | 數(shù)字媒體處理器 |
| 文件頁數(shù)： | 34/309頁 |
| 文件大小： | 2216K |
| 代理商： | TMX320DM6437BZWTA |
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www.ti.com
P
TMS320DM6437
Digital Media Processor
SPRS345B–NOVEMBER 2006–REVISED MARCH 2007
Table 2-10. EMIFA Terminal Functions (EMIFA Pinout Mode 1, AEM[2:0] = 001) (continued)
SIGNAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
This pin is multiplexed between VPFE (CCDC), EMIFA, and GPIO.
C_FIELD/
EM_A[21]/GP[34]
IPD
DV
DD33
D12
C16
I/O/Z
For EMIFA, it is address bit 21 output EM_A[21].
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI0(CCD8)/
EM_A[20]/
PINTA/
EM_D[7]/GP[44]
IPD
DV
DD33
C12
C15
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 20 output
EM_A[20] if AEAW[2:0] = 100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI1(CCD9)/
EM_A[19]/
PREQ/
EM_D[6]/GP[45]
IPD
DV
DD33
B12
C14
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 19 output
EM_A[19] if AEAW[2:0] = 100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI2(CCD10)/
EM_A[18]/
PRST/
EM_D[5]/GP[46]
IPD
DV
DD33
D11
A14
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 18 output
EM_A[18] if AEAW[2:0] = 011/100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI3(CCD11)/
EM_A[17]/
AD31/
EM_D[4]/GP[47]
IPD
DV
DD33
A11
B14
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 17 output
EM_A[17] if AEAW[2:0] = 011/100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI4(CCD12)/
EM_A[16]/
PGNT/
EM_D[3]/GP[48]
IPD
DV
DD33
C11
B13
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 16 output
EM_A[16] if AEAW[2:0] = 010/011/100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI5(CCD13)/
EM_A[15]/
AD29/
EM_D[2]/GP[49]
IPD
DV
DD33
B11
C13
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 15 output
EM_A[15] if AEAW[2:0] = 010/011/100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI6(CCD14)/
EM_A[14]/
AD27/
EM_D[1]/GP[50]
IPD
DV
DD33
A10
A13
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 14 output
EM_A[14] if AEAW[2:0] = 001/010/011/100b.
This pin is multiplexed between VPFE (CCDC), EMIFA, PCI, and
GPIO.
CI7(CCD15)/
EM_A[13]/
AD25/
EM_D[0]/GP[51]
IPD
DV
DD33
B10
A12
I/O/Z
For EMIFA (AEM[2:0] = 001), this pin is address bit 13 output
EM_A[13] if AEAW[2:0] = 001/010/011/100b.
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[12]/PCBE3/
GP[89]
IPD
DV
DD33
D10
B12
I/O/Z
For EMIFA, this pin is address bit 12 output EM_A[12].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[11]/AD24/
GP[90]
IPD
DV
DD33
C10
C12
I/O/Z
For EMIFA, this pin is address bit 11 output EM_A[11].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[10]/AD23/
GP[91]
IPD
DV
DD33
A9
B11
I/O/Z
For EMIFA, this pin is address bit 10 output EM_A[10].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[9]/PIDSEL/
GP[92]
IPD
DV
DD33
D9
C11
I/O/Z
For EMIFA, this pin is address bit 9 output EM_A[9].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[8]/AD21/
GP[93]
IPD
DV
DD33
B9
A11
I/O/Z
For EMIFA, this pin is address bit 8 output EM_A[8].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[7]/AD22/
GP[94]
IPD
DV
DD33
C9
C10
I/O/Z
For EMIFA, this pin is address bit 7 output EM_A[7].
This pin is multiplexed between EMIFA, PCI, and GPIO.
EM_A[6]/AD20/
GP[95]
IPD
DV
DD33
D8
B10
I/O/Z
For EMIFA, this pin is address bit 6 output EM_A[6].
Device Overview
34
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PDF描述 |
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