參數(shù)資料
型號： TMX320DM6437BZWTA
廠商： Texas Instruments, Inc.
英文描述： Digital Media Processor
中文描述： 數(shù)字媒體處理器
文件頁數(shù)： 61/309頁
文件大?。?/td> 2216K
代理商： TMX320DM6437BZWTA
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www.ti.com
P
TMS320DM6437
Digital Media Processor
SPRS345B–NOVEMBER 2006–REVISED MARCH 2007
Table 2-23. Multichannel Buffered Serial Port 0 and Multichannel Buffered Serial Port 1 (McBSP0 and
McBSP1) Terminal Functions
SIGNAL
TYPE
(1)
OTHER
(2)(3)
DESCRIPTION
ZWT
NO.
ZDU
NO.
NAME
Multichannel Buffered Serial Port 0 (McBSP0)
Pin Muxing Control
:
TBD
CLKS0/TOUT0L/
GP[97]
ACLKR0/CLKX0/
GP[99]
AHCLKR0/CLKR0/
GP[101]
IPD
DV
DD33
IPD
DV
DD33
IPD
DV
DD33
This pin is multiplexed between McBSP0, Timer0, and GPIO.
For McBSP0, it is McBSP0 external clock source (I).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 transmit clock CLKX0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 receive clock CLKR0 (I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 transmit frame synchronization FSX0
(I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 receive frame synchronization FSR0
(I/O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 data transmit output DX0 (O/Z).
This pin is multiplexed between McASP0, McBSP0, and GPIO.
For McBSP0, it is McBSP0 data receive input DR0 (I).
Multichannel Buffered Serial Port 1 (McBSP1)
J4
L3
I/O/Z
H1
J1
I/O/Z
J2
K1
I/O/Z
AXR0[2]/FSX0/
GP[103]
IPD
DV
DD33
H3
J2
I/O/Z
AXR0[3]/FSR0/
GP[102]
IPD
DV
DD33
G4
J3
I/O/Z
AXR0[1]/DX0/
GP[104]
AFSR0/DR0/
GP[100]
IPD
DV
DD33
IPD
DV
DD33
J3
K2
I/O/Z
H4
K3
I/O/Z
Pin Muxing Control: TBD
CLKS1/TINP0L/
GP[98]
ACLKX0/CLKX1/
GP[106]
AHCLKX0/CLKR1/
GP[108]
IPD
DV
DD33
IPD
DV
DD33
IPD
DV
DD33
This pin is multiplexed between McBSP1, Timer0, and GPIO.
For McBSP1, it is McBSP1 external clock source (I).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 transmit clock CLKX1 (I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 receive clock CLKR1 (I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 transmit frame synchronization FSX1
(I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 receive frame synchronization FSR1
(I/O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 data transmit output DX1 (O/Z).
This pin is multiplexed between McASP0, McBSP1, and GPIO.
For McBSP1, it is McBSP1 data receive input DR1 (I).
K2
L2
I/O/Z
F1
G1
I/O/Z
G1
H1
I/O/Z
AMUTEIN0/FSX1/
GP[109]
IPD
DV
DD33
F2
G3
I/O/Z
AXR0[0]/FSR1/
GP[105]
IPD
DV
DD33
H2
H2
I/O/Z
AFSX0/DX1/
GP[107]
AMUTE0/DR1/
GP[110]
IPD
DV
DD33
IPD
DV
DD33
G2
G2
I/O/Z
G3
H3
I/O/Z
(1)
(2)
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground, A = Analog signal
pullup/pulldown resistors are required, see
Section 3.9.1
,
Pullup/Pulldown Resistors
.
Specifies the operating I/O supply voltage for each signal
(3)
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Device Overview
61
相關(guān)PDF資料
PDF描述
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TMX320DM6443BZWT 制造商:Texas Instruments 功能描述:
TMX320DM6443CZWT 制造商:Texas Instruments 功能描述:
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