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參數資料
| 型號： | TMX320DM6443ZWT |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media System-on-Chip |
| 中文描述： | 數字媒體系統(tǒng)片上 |
| 文件頁數： | 107/221頁 |
| 文件大小： | 1582K |
| 代理商： | TMX320DM6443ZWT |
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www.ti.com
6.6.3
Clock PLL Electrical Data/Timing (Input and Output Clocks)
MXI/CLKIN
2
3
4
4
5
1
TMS320DM6443
Digital Media System-on-Chip
SPRS282E–DECEMBER 2005–REVISED MARCH 2007
Table 6-16. Timing Requirements for MXI/CLKIN (-594) Devices
(1)(2)(3)(4)
(see
Figure 6-14
)
-594
NO.
UNIT
MIN
33.3
0.45C
0.45C
MAX
1
2
3
4
5
t
c(MXI)
t
w(MXIH)
t
w(MXIL)
t
t(MXI)
t
J(MXI)
Cycle time, MXI/CLKIN
Pulse duration, MXI/CLKIN high
Pulse duration, MXI/CLKIN low
Transition time, MXI/CLKIN
Period jitter, MXI/CLKIN
50
ns
ns
ns
ns
ns
0.55C
0.55C
0.05C
0.02C
(1)
The MXI/CLKIN frequency and PLL multiply factor should be chosen such that the resulting clock frequency is within the specific range
for CPU operating frequency. For example, for a -594 speed device with a 27 MHz CLKIN frequency, the PLL multiply factor should be
≤
22.
The reference points for the rise and fall transitions are measured at V
MAX and V
MIN.
For more details on the PLL multiplier factors, see the
Documentation Support
section for ARM Subsystem User's Guide.
C = CLKIN cycle time in ns. For example, when MXI/CLKIN frequency is 27 MHz, use C = 37.037 ns.
(2)
(3)
(4)
Figure 6-14. MXI/CLKIN Timing
Submit Documentation Feedback
Peripheral and Electrical Specifications
107
相關PDF資料 |
PDF描述 |
|---|---|
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| TMS320DM648ZUT900 | Digital Media Processor |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| TMX320DM6446AZWT | 制造商:Texas Instruments 功能描述: |
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