參數(shù)資料
型號： TVP3010C
廠商： Texas Instruments, Inc.
英文描述： Video Interface Palette
中文描述： 視頻接口面板
文件頁數(shù)： 5/90頁
文件大?。?/td> 491K
代理商： TVP3010C
v
Section
Title
Page
Appendix A
Printed Circuit Board Layout Considerations
A–1
. . . . . . . . . . . . . . . . . . . . .
Appendix B
RCLK Frequency < VCLK Frequency
B–1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Appendix C
Little-Endian and Big-Endian Data Formats
C–1
. . . . . . . . . . . . . . . . . . . . . . .
Appendix D
Examples: Register Settings
D–1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Appendix E
Mechanical Data
E–1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
List of Illustrations
Title
Figure
Page
2–1
2–2
Dot Clock/VCLK/RCLK/SCLK Relationship
SCLK/VCLK Control Timing
(SSRT Disabled, RCLK/SCLK Frequency = VCLK Frequency)
SCLK/VCLK Control Timing
(SSRT Enabled, RCLK/SCLK Frequency = VCLK Frequency)
SCLK/VCLK Control Timing
(SSRT Disabled, RCLK/SCLK Frequency = 4 x VCLK Frequency)
SCLK/VCLK Control Timing
(SSRT Enabled, RCLK/SCLK Frequency = 4 x VCLK Frequency)
CursorRAM Organization
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Common Sprite-Origin Settings
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Dual-Cursor Positioning
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
One Possible Custom-Cursor Creation
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
VGA in the Auxiliary Window
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Multiple VGA Windows Using Port Select (PSEL)
Overscan
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Equivalent Circuit of the Current Output (IOG)
Composite Video Output (With 0 IRE, 8-Bit Output)
Composite Video Output (With 7.5 IRE, 8-Bit Output)
Split Shift Register Transfer Timing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2–7
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2–8
. . . . . . . . . . . . . . . .
2–3
2–9
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2–4
2–10
. . . . . . . . . . . .
2–5
2–10
2–24
2–25
2–26
2–26
2–29
2–30
2–32
2–35
2–36
2–36
2–37
. . . . . . . . . . . .
2–6
2–7
2–8
2–9
2–10
2–11
2–12
2–13
2–14
2–15
2–16
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. . . . . . . . . . . . . . . . . . . . . . .
3–1
3–2
3–3
MPU Interface Timing
Video Input/Output Timing
SFLAG Timing (When SSRT Function is Enabled)
3–11
3–12
3–13
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
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