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參數(shù)資料
| 型號(hào)： | XCF128XFTG64C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 36/88頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC PROM SRL 128M GATE 64-FTBGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 存儲(chǔ)容量： | 128Mb |
| 電源電壓： | 1.7 V ~ 2 V |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-TBGA |
| 供應(yīng)商設(shè)備封裝： | 64-TFBGA |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁(yè)面： | 601 (CN2011-ZH PDF) |
| 其它名稱： | 122-1578 |
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Platform Flash XL High-Density Configuration and Storage Device
DS617 (v3.0.1) January 07, 2010
Product Specification
41
R
X-Ref Target - Figure 21
Figure 21: First Address Latching Sequence (FALS): Clock is Free Running
Table 20: FALS Sequence Timings with Free-Running Clock
Symbol
Parameter
Voltage Range
Unit
VDDQ =
2.3V to 2.7V
VDDQ =
3.0V to 3.6V
TAVRWH
Address Valid before READY_WAIT High
Min
200
μs
TGLRWH
Output Enable Low before READY_WAIT High
Min
200
μs
TRWHAX
Address Hold time after READY_WAIT High
Min
4tK + 200(1)
μs
Notes:
1.
4tK = Fourth rising edge of clock (K) after READY_WAIT goes High.
K
V
DD/VDDQ
G
L
A22–A0
First Address
FFFFh (Sync + Dummy Cycle)
DQ15–DQ0
READY_WAIT
RP
High
E
Low
T
GLRWH
T
RWHAX
T
AVRWH
DS617_16_081309
1234
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PDF描述 |
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