參數(shù)資料
型號(hào)： XIO2200AZGW
廠商： Texas Instruments
文件頁數(shù)： 70/202頁
文件大?。?/td> 0K
描述： IC PCI-EXPRESS/BUS BRIDGE 176BGA
產(chǎn)品培訓(xùn)模塊： PCI Express Basics
標(biāo)準(zhǔn)包裝： 126
應(yīng)用： PCI Express 至 PCI 轉(zhuǎn)換橋
接口： PCI
電源電壓： 1.35 V ~ 1.65 V，3 V ~ 3.6 V
封裝/外殼： 176-LFBGA
供應(yīng)商設(shè)備封裝： 176-BGA MICROSTAR（15x15）
包裝： 托盤
安裝類型： 表面貼裝
產(chǎn)品目錄頁面： 882 (CN2011-ZH PDF)
配用： XIO2200AEVM-ND - XIO2200AEVM
其它名稱： 296-19567
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1394 OHCI Memory-Mapped Register Space
148
March 5 2007 June 2011
SCPS154C
8.27 Initial Bandwidth Available Register
The initial bandwidth available register value is loaded into the corresponding bus management CSR register
on a system (hardware) or software reset. See Table 819 for a complete description of the register contents.
OHCI register offset:
B0h
Register type:
Read-only, Read/Write
Default value:
0000 1333h
BIT NUMBER
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
RESET STATE
0
BIT NUMBER
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET STATE
0
1
0
1
0
1
0
1
Table 819. Initial Bandwidth Available Register Description
BIT
FIELD NAME
TYPE
DESCRIPTION
3113
RSVD
R
Reserved. Bits 3113 return 000 0000 0000 0000 0000b when read.
120
InitBWAvailable
RW
This field is reset to 1333h on a system (hardware) or software reset, and is not affected by a 1394
bus reset. The value of this field is loaded into the BANDWIDTH_AVAILABLE CSR register upon
a GRST, PERST, PRST, or a 1394 bus reset.
8.28 Initial Channels Available High Register
The initial channels available high register value is loaded into the corresponding bus management CSR
register on a system (hardware) or software reset. See Table 820 for a complete description of the register
contents.
OHCI register offset:
B4h
Register type:
Read/Write
Default value:
FFFF FFFFh
BIT NUMBER
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
RESET STATE
1
BIT NUMBER
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET STATE
1
Table 820. Initial Channels Available High Register Description
BIT
FIELD NAME
TYPE
DESCRIPTION
310
InitChanAvailHi
RW
This field is reset to FFFF_FFFFh on a system (hardware) or software reset, and is not affected by
a 1394 bus reset. The value of this field is loaded into the CHANNELS_AVAILABLE_HI CSR
register upon a GRST, PERST, PRST, or a 1394 bus reset.
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