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參數(shù)資料
| 型號： | XR88C681P/40-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 23/101頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART CMOS DUAL 40PDIP |
| 標(biāo)準(zhǔn)包裝： | 9 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 2，DUART |
| FIFO's： | 1 字節(jié)，3 字節(jié) |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 帶并行端口： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 40-DIP（0.600"，15.24mm） |
| 供應(yīng)商設(shè)備封裝： | 40-PDIP |
| 包裝： | 管件 |
| 其它名稱： | 1016-1640 XR88C681P/40-F-ND |
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XR88C681
28
Rev. 2.11
CPU, from a external crystal.
The 8228 System
Controller is responsible for buffering the bi-directional
Data Bus. Additionally, since the 8080 CPU device does
not directly provide control bus signals, the 8228 Device is
responsible for translating signaling information, from the
8080A device, into the following Control Bus signals; in
order to access memory and peripheral devices.
-INTA - Interrupt Acknowledge
-MEMR - Memory Read
-MEMW - Memory Write
-IOR - Input Port Read
-IOW - Output Port Write
Figure 6 presents a schematic of the 8080A CPU Module.
PHI2 (TTL)
INT
INTE
D0
D1
D2
D3
D4
D5
D6
D7
8080A CPU
8228
System
Controller
INTA
DBIN
8224
Clock
Generator
MEMR
MEMW
IOR
IOW
A0 - A15
-BUSEN
-STATUS STROBE
HDLA
-WR
SYNC
TANK
OSC
RDYIN
-RESIN
+12V
+5V
GND
RESET
READY
1
2
WAIT
GND
+5V
GND
+5V
-5V
+12V
HOLD
D0
D1
D2
D3
D4
D5
D6
D7
Figure 6. Schematic of 8080A CPU Module
8080A CPU Module Interrupt Structure
The “Interrupt Structure” of the 8080A CPU is described
here. The 8080A CPU device consists of two signals:
INTE and INT. Additionally, the 8228 Bi-Directional Bus
consists of a single output signal, -INTA. INTE is the
active-high Interrupt Enable output, and INT is the
active-high Interrupt Request input.
If the “Enable
Interrupt” command has been invoked, the INTE output
will be “high” indicating that the 8080 CPU will honor
interrupt requests from peripherals. Whenever the INT
pin is asserted by a peripheral device requesting an
interrupt, the CPU will complete its current instruction.
After completion of this instruction, the CPU module will
assert -INTA via the 8228 Bi-Directional Bus Driver (U2)
by toggling -INTA “l(fā)ow”. -INTA is the active-low “Interrupt
Acknowledge” signal that the CPU module outputs in
order to initiate the process of interrupt servicing. The
8080A
CPU
module
only
supports
“external”
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