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參數(shù)資料
| 型號(hào)： | XR88C681P/40-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 48/101頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC UART CMOS DUAL 40PDIP |
| 標(biāo)準(zhǔn)包裝： | 9 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 2，DUART |
| FIFO's： | 1 字節(jié)，3 字節(jié) |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 帶并行端口： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 通孔 |
| 封裝/外殼： | 40-DIP（0.600"，15.24mm） |
| 供應(yīng)商設(shè)備封裝： | 40-PDIP |
| 包裝： | 管件 |
| 其它名稱： | 1016-1640 XR88C681P/40-F-ND |
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XR88C681
50
Rev. 2.11
Figure 23. Schematic of the XR88C681 DUART Device Interfacing to a
“Min” Mode 8086 CPU Device
-RD
-WR
AD0 - AD7
AD8 - AD15
INTR
ALE
HOLD
M/
-IO
-RD
-WR
-DEN
DT/
-R
8086 CPU
C
74LS373
C
D0 - D7
A0 - A3
D8 - D15
A8 - A15
-MEMW
-MEMR
MN/
-MX
Vcc
-INTA
D0 - D7
A4 - A7
Address
Decoder
-CS
-INTR
-IACK
A0 - A3
IEI
from higher
priority device
XR88C681
D
Q
D
Q
D. TIMING CONTROL BLOCK
The Timing Control Block allows to the user to specify the
bit rates that he/she wishes to transmit and receive data at
each channel. The Timing Control Block consists of the
following elements:
D
Oscillator Circuit
D
Bit Rate Generator
D
16 bit Counter/Timer
D
4 - External Input Pins (to clock the Transmitters
and Receivers, directly)
D
Two Clock Select Registers (32:1 MUXs)
Figure 24 presents a block diagram of the Timing Control
block for the XR88C681 device.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MS27472T16B8PA | CONN RCPT 8POS WALL MT W/PINS |
| MS27473E12F8PA | CONN PLUG 8POS STRAIGHT W/PINS |
| VI-JWH-IW-F3 | CONVERTER MOD DC/DC 52V 100W |
| VI-JWH-IW-F2 | CONVERTER MOD DC/DC 52V 100W |
| VI-JWH-IW-F1 | CONVERTER MOD DC/DC 52V 100W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XR88C681XR101524CNN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| XR88C681XR101524M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| XR88C681XR101524N | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| XR88C681XR101528CJJ | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| XR88C681XR101528CNN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
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