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參數(shù)資料
| 型號： | 82845MZ |
| 廠商： | INTEL CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Intel 845 Family Chipset-Mobile 82845MP/82845MZ Chipset Memory Controller Hub Mobile (MCH-M) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PBGA593 |
| 封裝： | 37.50 X 37.50 MM, FCBGA-593 |
| 文件頁數(shù)： | 29/157頁 |
| 文件大?。?/td> | 1407K |
| 代理商： | 82845MZ |
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Intel
82845MP/82845MZ Chipset-Mobile (MCH-M)
250687-002
Datasheet
29
R
Signal Name
Type
Description
G_PAR
I/O
AGP
Parity
During FRAME# Operation:
G_PAR is driven by the MCH-M when it acts as a
FRAME#-based AGP initiator during address and data phases for a write cycle,
and during the address phase for a read cycle. G_PAR is driven by the MCH-M
when it acts as a FRAME#-based AGP target during each data phase of a
FRAME#-based AGP memory read cycle. Even parity is generated across
G_AD[31:0] and G_CBE[3:0]#.
During SBA and PIPE# Operation:
This signal is not used during SBA and PIPE#
operation.
NOTE:
PCIRST# from the ICH3-M is connected to RSTIN# and is used to reset AGP interface logic within the
MCH-M. The AGP agent will also use PCIRST# provided by the ICH3-M as an input to reset its internal
logic.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82845PE | 82845GE Graphics and Memory Controller Hub (GMCH) and 82845PE Memory Controller Hub (MCH) |
| 82845GE | 82845GE Graphics and Memory Controller Hub (GMCH) and 82845PE Memory Controller Hub (MCH) |
| 8284A | Clock Generator and Driver for 8066, 8088 Processors |
| 8284A-1 | Clock Generator and Driver for 8066, 8088 Processors |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82845PE | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:82845GE Graphics and Memory Controller Hub (GMCH) and 82845PE Memory Controller Hub (MCH) |
| 8284611SM | 制造商:Thomas & Betts 功能描述: |
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