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參數(shù)資料
| 型號： | 82845MZ |
| 廠商： | INTEL CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Intel 845 Family Chipset-Mobile 82845MP/82845MZ Chipset Memory Controller Hub Mobile (MCH-M) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PBGA593 |
| 封裝： | 37.50 X 37.50 MM, FCBGA-593 |
| 文件頁數(shù)： | 92/157頁 |
| 文件大?。?/td> | 1407K |
| 代理商： | 82845MZ |
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Intel
82845MP/82845MZ Chipset-Mobile (MCH-M)
92
Datasheet
250687-002
R
3.8.10.
PBUSN1 – Primary Bus Number Register – Device #1
Offset:
Default:
Access:
Size:
18h
00h
Read Only
8 bits
This register identifies that “virtual” PCI-PCI Bridge is connected to bus #0.
Bit
Descriptions
7:0
Bus Number.
Hardwired to “0.”
3.8.11.
SBUSN1 – Secondary Bus Number Register – Device #1
Offset:
Default:
Access:
Size:
19h
00h
Read /Write
8 bits
This register identifies the bus number assigned to the second bus side of the “virtual” PCI-PCI bridge
i.e. to AGP. This number is programmed by the PCI configuration software to allow mapping of
configuration cycles to AGP.
Bit
Descriptions
7:0
Bus Number.
Programmable. Default = “00h”.
3.8.12.
SUBUSN1 – Subordinate Bus Number Register – Device #1
Offset:
Default:
Access:
Size:
1Ah
00h
Read /Write
8 bits
This register identifies the subordinate bus (if any) that resides at the level below AGP. This number is
programmed by the PCI configuration software to allow mapping of configuration cycles to AGP.
Bit
Descriptions
7:0
Bus Number.
Programmable. Default = “00h”.
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PDF描述 |
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