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參數(shù)資料
| 型號： | 82865G |
| 廠商： | Intel Corp. |
| 英文描述： | Intel 865G/865GV Graphics and Memory Controller Hub |
| 中文描述： | 英特爾865G/865GV圖形和內(nèi)存控制器中樞 |
| 文件頁數(shù)： | 146/249頁 |
| 文件大小： | 3540K |
| 代理商： | 82865G |
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Intel
82865G/82865GV GMCH Datasheet
147
Functional Description
Functional Description
5
This chapter describes the GMCH interfaces and functional units including the processor system
bus interface, the AGP interface, system memory controller, integrated graphics device, DVO
interfaces, display interfaces, power management, and clocking.
5.1
Processor Front Side Bus (FSB)
The GMCH supports a single Pentium 4 processor with 512-KB L2 cache on 0.13 micron process
in a 478-pin package or the Pentium 4 processor on 90 nm process. The GMCH supports FSB
frequencies of 400 MHz, 533 MHz, and 800 MHz using a scalable FSB VTT voltage and on-die
termination. It supports 32-bit host addressing, decoding up to 4 GB of the processor’s memory
address space. Host-initiated I/O cycles are decoded to AGP/PCI_B, Hub Interface, or the GMCH
configuration space. Host-initiated memory cycles are decoded to AGP/PCI_B, Hub Interface or
system memory. All memory accesses from the host interface that hit the graphics aperture are
translated using an AGP address translation table. AGP/PCI_B device accesses to non-cacheable
system memory are not snooped on the host bus. Memory accesses initiated from AGP/PCI_B
using PCI semantics and from the hub interface to system memory will be snooped on the host bus.
The GMCH supports the Pentium 4 processor subset of the Enhanced Mode Scalable Bus. The
cache line size is 64 bytes. Source synchronous transfer is used for the address and data signals. At
100/133/200 MHz bus clock the address signals are double pumped to run at 200/266/400 MHz
and a new address can be generated every other bus clock. At 100/133/200 MHz bus clock the data
signals are quad pumped to run at 400/533/800 MHz and an entire 64-B cache line can be
transferred in two bus clocks.
The GMCH integrates AGTL+ termination resistors on die. The GMCH has an IOQ depth of 12.
The GMCH supports one outstanding deferred transaction on the FSB.
5.1.1
FSB Dynamic Bus Inversion
The GMCH supports Dynamic Bus Inversion (DBI) when driving and when receiving data from
the processor. DBI limits the number of data signals that are driven to a low voltage on each quad
pumped data phase. This decreases the worst-case power consumption of the GMCH. DINV[3:0]#
indicate if the corresponding 16 bits of data are inverted on the bus for each quad pumped data
phase:
DINV[3:0]#
DINV0#
DINV1#
DINV2#
DINV3#
Data Bits
HD[15:0]#
HD[31:16]#
HD[47:32]#
HD[63:48]#
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82865GV | Intel 865G/865GV Graphics and Memory Controller Hub |
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參數(shù)描述 |
|---|---|
| 82865GV | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel 865G/865GV Graphics and Memory Controller Hub |
| 82865N | 功能描述:HEX DIE 5/8-11 制造商:apex tool group 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1 |
| 828661-1 | 功能描述:汽車連接器 25P JUN-TIMER CONN RoHS:否 制造商:Amphenol SINE Systems 產(chǎn)品:Contacts 系列:ATP 位置數(shù)量: 型式:Female 安裝風(fēng)格: 端接類型: 觸點電鍍:Nickel |
| 828662-1 | 制造商:TE Connectivity 功能描述:CONN TIMER CONN M 16 POS 5MM SLDR ST TH - Bulk 制造商:TE Connectivity 功能描述:16P JUN-TIMER STECK 制造商:TE Connectivity 功能描述:Conn Timer Connector M 16 POS 5mm Solder ST Thru-Hole |
| 82866N | 功能描述:HEX DIE 5/8-18 制造商:apex tool group 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1 |
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