參數(shù)資料
型號(hào)： 82865GV
廠商： Intel Corp.
英文描述： Intel 865G/865GV Graphics and Memory Controller Hub
中文描述： 英特爾865G/865GV圖形和內(nèi)存控制器中樞
文件頁(yè)數(shù)： 97/249頁(yè)
文件大?。?/td> 3540K
代理商： 82865GV
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98
Intel
82865G/82865GV GMCH Datasheet
Register Description
3.6.19
PMBASE1—Prefetchable Memory Base Address Register
(Device 1)
Address Offset:
Default Value:
Access:
Size:
24–25h
FFF0h
RO, R/W
16 bits
This register controls the processor-to-PCI_B prefetchable memory accesses routing based on the
following formula:
PREFETCHABLE_MEMORY_BASE
≤
address
≤
PREFETCHABLE_MEMORY_LIMIT
The upper 12 bits of the register are read/write and correspond to the upper 12 address bits
A[31:20] of the 32-bit address. The bottom 4 bits of this register are read only and return zeros
when read. This register must be initialized by the configuration software. For the purpose of
address decode, address bits A[19:0] are assumed to be 0. Thus, the bottom of the defined memory
address range will be aligned to a 1-MB boundary.
3.6.20
PMLIMIT1—Prefetchable Memory Limit Address Register
(Device 1)
Address Offset:
Default Value:
Access:
Size:
26–27h
0000h
RO, R/W
16 bits
This register controls the processor-to-PCI_B prefetchable memory accesses routing based on the
following formula:
PREFETCHABLE_MEMORY_BASE
≤
address
≤
PREFETCHABLE_MEMORY_LIMIT
The upper 12 bits of the register are read/write and correspond to the upper 12 address bits
A[31:20] of the 32-bit address. The bottom 4 bits of this register are read only and return zeroes
when read. This register must be initialized by the configuration software. For the purpose of
address decode, address bits A[19:0] are assumed to be FFFFFh. Thus, the top of the defined
memory address range will be at the top of a 1-MB aligned memory block. Note that prefetchable
memory range is supported to allow segregation by the configuration software between the
memory ranges that must be defined as UC and the ones that can be designated as a USWC
(i.e., prefetchable) from the processor perspective.
Bit
Descriptions
15:4
Prefetchable Memory Address Base (PMBASE)—R/W.
This field corresponds to A[31:20] of the
lower limit of the address range passed by bridge Device 1 across AGP/PCI_B.
3:0
Reserved.
Bit
Descriptions
15:4
Prefetchable Memory Address Limit (PMLIMIT)—R/W.
This field corresponds to A[31:20] of the
upper limit of the address range passed by bridge Device 1 across AGP/PCI_B.
3:0
Reserved.
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PDF描述
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82866N 功能描述:HEX DIE 5/8-18 制造商:apex tool group 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1
82867001 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MOTOR GEARED 12VDC 344RPM
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