Table 24. SDRAM Interface Timing1 Parameter Min Max U" />
參數(shù)資料
型號: ADSP-21371KSWZ-2B
廠商: Analog Devices Inc
文件頁數(shù): 19/48頁
文件大?。?/td> 0K
描述: IC DSP 32BIT 266MHZ 208-LQFP
產(chǎn)品培訓模塊: SHARC Processor Overview
標準包裝: 1
系列: SHARC®
類型: 浮點
接口: DAI,DPI
時鐘速率: 266MHz
非易失內(nèi)存: ROM(512 kB)
芯片上RAM: 128kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.20V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 208-LQFP 裸露焊盤
供應(yīng)商設(shè)備封裝: 208-LQFP-EP(28x28)
包裝: 托盤
ADSP-21371
SDRAM Interface Timing (133 MHz SDCLK)
Table 24. SDRAM Interface Timing1
Parameter
Min
Max
Unit
Timing Requirements
tSSDAT
DATA Setup Before SDCLK
tHSDAT
DATA Hold After SDCLK
Switching Characteristics
tSDCLK
SDCLK Period
tSDCLKH
SDCLK Width High
tSCCLKL
SDCLK Width Low
tDCAD
Command, ADDR, Data Delay After SDCLK2
tHCAD
Command, ADDR, Data Hold After SDCLK2
tDSDAT
Data Disable After SDCLK
tENSDAT
Data Enable After SDCLK
0.58
2.2
7.5
3
1.3
1.6
5.3
ns
1 For FCCLK = 133 MHz (SDCLK ratio = 1:2).
2 Command pins include: SDCAS, SDRAS, SDWE, MSx, SDA10, and SDCKE.
tHCAD
tDSDAT
tDCAD
tSSDAT
tDCAD
tENSDAT
tHSDAT
tSDCLKL
tSDCLKH
tSDCLK
SDCLK
DATA (IN)
DATA(OUT)
CMND ADDR
(OUT)
Figure 16. SDRAM Interface Timing for 133 MHz SDCLK
Rev. 0
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June 2007
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PDF描述
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