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參數(shù)資料
| 型號(hào)： | DS3184N+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 294/400頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PACKET PHY W/LIU 400-CSBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 類型： | 調(diào)幀器 |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應(yīng)商設(shè)備封裝： | 400-PBGA（27x27） |
| 包裝： | 管件 |
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DS3181/DS3182/DS3183/DS3184
363
12.14.4.1 Register Bit Descriptions
Register Name:
PP.RCR
Register Description:
Packet Processor Receive Control Register
Register Address:
(1,3,5,7)C0h
Bit #
15
14
13
12
11
10
9
8
Name
RMNS7
RMNS6
RMNS5
RMNS4
RMNS3
RMNS2
RMNS1
RMNS0
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
Reserved
RFPD
RF16
RFED
RDD
RBRE
RPTE
Default
0
Bits 15 to 8: Receive Minimum Packet Size (RMNS[7:0]) – These eight bits indicate the minimum allowable
packet size in bytes. The size includes the FCS bytes, but excludes bit/byte stuffing. Note: In FCS-32 mode,
packets with six bytes are the minimum packet size allowed, in FCS-16 mode, packets with four bytes are the
minimum packet size allowed, and when FCS processing is disabled, packets with two bytes are the minimum
packet size allowed. Packets less than the minimum size will be aborted.
Bit 5: Receive FCS Processing Disable (RFPD) – When 0, FCS processing is performed (the packets have an
FCS appended). When 1, FCS processing is disabled (the packets do not have an FCS appended).
Bit 4: Receive FCS-16 Enable (RF16) – When 0, the error checking circuit uses a 32-bit FCS. When 1, the error
checking circuit uses a 16-bit FCS. This bit is ignored when FCS processing is disabled.
Bit 3: Receive FCS Extraction Disable (RFED) – When 0, the FCS bytes are discarded. When 1, the FCS bytes
are passed on. This bit is ignored when FCS processing is disabled.
Bit 2: Receive Descrambling Disable (RDD) – When 0, descrambling is performed. When 1, descrambling is
disabled.
Bit 1: Receive Bit Reordering Enable (RBRE) – When 0, bit reordering is disabled (The first bit received is stored
in the MSB of the receive FIFO byte). When 1, bit reordering is enabled (The first bit received is stored in the LSB
of the receive FIFO byte).
Bit 0: Receive Pass-Through Enable (RPTE) – When 0, pass-through mode is disabled and packet processing is
enabled. When 1, pass-through mode is enabled, and all packet-processing functions except descrambling and bit
reordering are disabled.
Register Name:
PP.RMPSC
Register Description:
Packet Processor Receive Maximum Packet Size Control Register
Register Address:
(1,3,5,7)C2h
Bit #
15
14
13
12
11
10
9
8
Name
RMX15
RMX14
RMX13
RMX12
RMX11
RMX10
RMX9
RMX8
Default
0
1
0
Bit #
7
6
5
4
3
2
1
0
Name
RMX7
RMX6
RMX5
RMX4
RMX3
RMX2
RMX1
RMX0
Default
0
Bits 15 to 0: Receive Maximum Packet Size (RMX[15:0]) – These 16 bits indicate the maximum allowable
packet size in bytes. The size includes the FCS bytes, but excludes bit/byte stuffing. Note: If the maximum packet
length is less than the minimum packet length, all packets will be aborted. When packet processing is disabled,
these 16 bits indicate the "packet" size the incoming data is to be broken into.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3184+ | IC PACKET PHY W/LIU 400-CSBGA |
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參數(shù)描述 |
|---|---|
| DS3184N+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| DS318PIN | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC |
| DS-318PIN | 制造商:MA-COM 制造商全稱:M/A-COM Technology Solutions, Inc. 功能描述:Plug-In Two-Way Power Divider, 5 - 500 MHz |
| DS-318-PIN | 功能描述:信號(hào)調(diào)節(jié) RoHS:否 制造商:EPCOS 產(chǎn)品:Duplexers 頻率:782 MHz, 751 MHz 頻率范圍: 電壓額定值: 帶寬: 阻抗:50 Ohms 端接類型:SMD/SMT 封裝 / 箱體:2.5 mm x 2 mm 工作溫度范圍:- 30 C to + 85 C 封裝:Reel |
| DS319 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Two-Way Power Divider 10500 MHz |
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