參數(shù)資料
型號(hào)： DS3184N+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 385/400頁(yè)
文件大?。?/td> 0K
描述： IC PACKET PHY W/LIU 400-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 40
類型： 調(diào)幀器
應(yīng)用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 管件
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DS3181/DS3182/DS3183/DS3184
85
8.3.5.4
POS-PHY Level 3 Functional Timing
Figure 8-38 shows a multiport transmit interface multiple packet transfer to different PHY ports. On clock edge 1,
PHY port 'N' indicates to the POS device that it can accept a block of packet data by asserting TPXA. On clock
edge 3, the POS device selects PHY port 'N' by placing its address on TDATA and asserting TSX while
TEN is
deasserted. On clock edge 4, the POS device starts a packet transfer to PHY port 'N' by deasserting TSX,
asserting
TEN, placing the first byte of packet data on TDATA, and asserting TSOX to indicate the transfer of the
first byte of the packet. On clock edge 5, the POS device deasserts TSOX as it continues to place additional bytes
of the packet on TDATA and PHY port 'N' asserts TSPA. On clock edge 11, the POS device polls PHY port 'L'. On
clock edge 12, PHY port 'N' indicates that it cannot accept any more data transfers by deasserting TSPA. On clock
edge 13, PHY port 'L' indicates to the POS device that it can accept a block of packet data by asserting TPXA. On
clock edge 14, the POS device deasserts
TEN to end the packet transfer process to PHY port 'N' and selects PHY
port 'L' by placing its address on TDATA and asserting TSX while
TEN is deasserted. On clock edge 15, the POS
device starts a packet transfer to PHY port 'L' by asserting
TEN, deasserting TSX, placing the first byte of packet
data on TDATA, and asserting TSOX to indicate the transfer of the first byte of the packet. On clock edge 16, the
POS device deasserts TSOX as it continues to place additional bytes of the packet on TDATA and PHY port 'L'
asserts TSPA.
Figure 8-38. POS-PHY Level 3 Transmit Multiple Packet Transfer In-Band Addressing
M
N
O
L
P
P39
P38
PM
O
LN
P40
P41
P42
TCLK
TADR
TPXA
P
M
N
O
P
L
M
N
OP
L
N
1
19
20
23
4
5
7
6
8
10
11
12
13
14
15
16
17
18
9
X
P5
P6
X
TEN
TEOP
TERR
TDAT
Transfer
To PHY
N
LN
P
M
TSPA
OP
M
O
L
N
P43
TSOX
P44
L
P1
P2
P3
P4
TSX
M
O
…
M
L
N
…
N
P1
P2
…
P
L
Figure 8-39 shows a multiport receive-interface multiple packet transfer from different ports. On clock edge 1, the
POS device indicates to PHY port 'N' that it is ready to accept a block of packet data by asserting
REN. On clock
edge 3, the PHY device selects port 'N' for transfer by asserting RSX and placing its address on RDATA. On clock
edge 4, PHY port 'N' starts packet transfer by deasserting RSX, asserting RVAL, placing the first byte of the packet
on RDATA, and asserting RSOX to indicate that this is the first transfer of the packet. On clock edge 5, PHY port
'N' deasserts RSOX as it leaves RVAL asserted and continues to place additional bytes of the packet on RDATA.
On clock edge 10, PHY port 'N' places the last byte of the packet on RDATA, and asserts REOP to indicate that
this is the last transfer of the packet. On clock edge 11, the PHY device deasserts RVAL and REOP ending the
packet transfer process from port 'N' and selects PHY port 'L' for transfer by asserting RSX and placing its address
on RDATA. On clock edge 12, PHY port 'L' starts packet transfer by deasserting RSX, asserting RVAL, placing the
first byte of the packet on RDATA, and asserting RSOX to indicate that this is the first transfer of the packet. On
clock edge 13, PHY port 'L' deasserts RSOX as it leaves RVAL asserted and continues to place additional bytes of
the packet on RDATA.
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PDF描述
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DS3184N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad ATM/Packet PHYs w/Built-In LIU RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS318PIN 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Industrial Control IC
DS-318PIN 制造商:MA-COM 制造商全稱:M/A-COM Technology Solutions, Inc. 功能描述:Plug-In Two-Way Power Divider, 5 - 500 MHz
DS-318-PIN 功能描述:信號(hào)調(diào)節(jié) RoHS:否 制造商:EPCOS 產(chǎn)品:Duplexers 頻率:782 MHz, 751 MHz 頻率范圍: 電壓額定值: 帶寬: 阻抗:50 Ohms 端接類型:SMD/SMT 封裝 / 箱體:2.5 mm x 2 mm 工作溫度范圍:- 30 C to + 85 C 封裝:Reel
DS319 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Two-Way Power Divider 10500 MHz
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