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參數(shù)資料
| 型號： | GT-48002A |
| 廠商： | Galileo Technology Services, LLC |
| 英文描述： | Switched Fast Ethernet Controller for 100BaseX(100BaseX交換式快速以太網(wǎng)控制器) |
| 中文描述： | 交換式快速以太網(wǎng)控制器（100BaseX交換式快速以太網(wǎng)控制器的100BaseX） |
| 文件頁數(shù)： | 75/102頁 |
| 文件大?。?/td> | 1001K |
| 代理商： | GT-48002A |
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GT-48002A Switched Fast Ethernet Controller
74
Revision 1.2
22.
Register Tables
The GT-48002A incorporates the required PCI Configuration registers, Command registers and various counters for
management purposes. The GT-48002A can work in stand-alone mode, in which there is no requirement for CPU inter-
vention (a system with no CPU) in which case the default values of the control registers are used.
The actual address of an internal register is the sum of the GT-48002A base address and the particular register’s off-
set. The CPU defines the base address by writing to the Internal Registers Base Address register in the PCI Configura-
tion area.
22.1
Register Map
De scr ipt i on
Off s e t
Internal Control Registers
Global Control
0x140028
Port Control 0
0x040200
Port Control 1
0x040204
Status
0x14002c
CPU and Sniffer Numbers
0x140030
Interrupt Cause
0x044
Interrupt Mask
0x048
Serial Parameters
0x040220
Receive Buffers Threshold
0x040224
CPU Buffer Base Address
0x140034
CPU Start Of Packet Base Address
0x140038
CPU New Address Base Address
0x14003c
CPU Intervention Base Address
0x140048
Device Table
0x40
Timeout Counter
0x04c
Port 0 Counter Block
0x040000 - 0x040054
Port 1 Counter Block
0x040058 - 0x0400ac
PCI Global Counters
0x140040 -0x140044
SMI Register
0x14004c
PCI Configuration
Device and Vendor ID
0x000
Status and Command
0x004
Class Code and Revision ID
0x008
Header Type, Latency Timer, Cache Line
0x00c
Internal/DRAM Base Address Register
0x010
Interrupt Pin and Line
0x03c
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PDF描述 |
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