- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377599 > L80227 (LSI CORP) 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80227 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 28/158頁 |
| 文件大?。?/td> | 1084K |
| 代理商： | L80227 |
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Draft 6/5/00
2-8
Functional Description
Copyright 1999 by LSI Logic Corporation. All rights reserved.
2.3 Block Diagram Description
The L80227 PHY device has the following main blocks:
Oscillator and Clock
Controller Interface
4B5B/Manchester Encoder/Decoder
Scrambler/Descrambler
Twisted-Pair Transmitter
Twisted-Pair Receiver
Clock and Data Recovery
AutoNegotiation/Link Integrity
Descrambler
Collision Detection
LED Drivers
A Management Interface (MI) serial port provides access to eight internal
PHY registers.
Figure 2.1
shows the main blocks, along with their associated signals.
The following sections describe each of the blocks in
Figure 2.1
. The
performance of the device in both the 10 and 100 Mbits/s modes is
described.
2.3.1 Oscillator and Clock
The L80227 requires a 25 MHz reference frequency for internal signal
generation. This 25 MHz reference frequency is generated with either an
external 25 MHz crystal connected between OSCIN and GND or with the
application of an external 25-MHz clock to OSCIN.
The device provides either a 2.5-MHz or 25-MHz reference clock at the
TX_CLK or RX_CLK output pins for 10-MHz or 100 MHz operation,
respectively.
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