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參數(shù)資料
| 型號： | LXP730 |
| 廠商： | Intel Corp. |
| 元件分類： | 通信及網(wǎng)絡 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 69/70頁 |
| 文件大小： | 531K |
| 代理商： | LXP730 |
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Multi-Rate DSL Framer
—
LXP730
Datasheet
69
5.15
Interrupt Registers (2 bytes)
5.15.1
Interrupt Enables
Address: 3E
Abbreviation: INT_EN
Read/Write
5.15.2
Interrupt Status
Address: 3F
Abbreviation: INT_STAT
Read/Write
Table 84. Interrupt Enables
Bit
Name
Default
Description
7
LOS_EN
0
Loss of source interrupt enable (set to
‘
1
’
to enable).
6
CRC_FEBE_E
N
0
CRC - FEBE interrupt enable.
5
INDCR_EN
0
indcr interrupt enable.
4
SLIP_DET_ EN
0
Slip detect interrupt enable.
3
OHMX_EN
0
Overhead MX interrupt enable.
2
OHDX_EN
0
Overhead DX interrupt enable.
1
ACTIVE_EN
0
ACTIVE interrupt enable.
0
COFA_EN
0
COFA interrupt enable.
Table 85. Interrupt Status
Bit
Name
Default
Description
7
LOS
0
loss of source interrupt, set to
‘
1
’
when los is received in dx1/los.
6
CRC_FEBE
0
CRC - FEBE interrupt, set to
‘
1
’
when 1.) CRC error is detected in
DX, or 2.) febe is received in dx2/febe.
5
INDCR
0
indcr interrupt, set to
‘
1
’
when indcr is received in dx30/indcr.
4
SLIP_DET
0
Slip detect interrupt, set to
‘
1
’
when slip occurs in slip buffer.
3
OHMX
0
Overhead MX interrupt, set to
‘
1
’
when MX frame has started
allowing 6ms to write MX registers before start of next frame.
2
OHDX
0
Overhead DX interrupt, set to
‘
1
’
when DX frame has ended allowing
6ms to read DX registers before end of next frame.
1
ACTIVE
0
ACTIVE interrupt, set to
‘
1
’
when MDSL link is up.
0
COFA
0
COFA interrupt, set to
‘
1
’
when change of frame position occurs.
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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