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參數(shù)資料
| 型號： | PI7C8150BMAE |
| 廠商： | Pericom |
| 文件頁數(shù)： | 99/109頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PCI-PCI BRIDGE ASYNC 208-FQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | * |
| 應(yīng)用： | * |
| 接口： | * |
| 電源電壓： | * |
| 封裝/外殼： | 208-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 208-FQFP（28x28） |
| 包裝： | 管件 |
| 安裝類型： | 表面貼裝 |
| 產(chǎn)品目錄頁面： | 1227 (CN2011-ZH PDF) |
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PI7C8150B
ASYNCHRONOUS 2-PORT PCI-TO-PCI BRIDGE
ADVANCE INFORMATION
Page 9 of 109
April 2009 – Revision 1.08
LIST OF TABLES
Table 2-1. Pin List – 208-pin FQFP............................................................................................................ 18
Table 2-2. Pin List – 256-pin PBGA............................................................................................................ 20
Table 3-1. PCI Transactions ........................................................................................................................ 22
Table 3-2. Write Transaction Forwarding .................................................................................................. 23
Table 3-3. Write Transaction Disconnect Address Boundaries................................................................... 26
Table 3-4. Read Prefetch Address Boundaries............................................................................................ 28
Table 3-5. Read Transaction Prefetching.................................................................................................... 28
Table 3-6. Device Number to IDSEL S_AD Pin Mapping........................................................................... 32
Table 3-7. Delayed Write Target Termination Response ............................................................................ 37
Table 3-8. Response to Posted Write Target Termination........................................................................... 37
Table 3-9. Response to Delayed Read Target Termination .........................................................................38
Table 5-1. Summary of Transaction Ordering ............................................................................................ 48
Table 6-1. Setting the Primary Interface Detected Parity Error Bit ........................................................... 56
Table 6-2. Setting Secondary Interface Detected Parity Error Bit.............................................................. 57
Table 6-3. Setting Primary Interface Master Data Parity Error Detected Bit ............................................ 57
Table 6-4. Setting Secondary Interface Master Data Parity Error Detected Bit......................................... 58
Table 6-5. Assertion of P_PERR_L ............................................................................................................. 58
Table 6-6. Assertion of S_PERR_L.............................................................................................................. 59
Table 6-7. Assertion of P_SERR_L for Data Parity Errors......................................................................... 60
Table 10-1. GPIO Operation....................................................................................................................... 69
Table 10-2. GPIO Serial Data Format........................................................................................................ 70
Table 11-1. Power Management Transitions .............................................................................................. 71
Table 16-1. TAP Pins .................................................................................................................................. 99
Table 16-2. JTAG Boundary Register Order............................................................................................. 101
LIST OF FIGURES
Figure 8-1
Secondary Arbiter Example.................................................................................................... 65
Figure 16-1
Test Access Port Block Diagram .......................................................................................... 98
Figure 17-1
PCI Signal Timing Measurement Conditions ..................................................................... 105
Figure 18-1
208-pin FQFP Package Outline......................................................................................... 107
Figure 18-2
256-pin PBGA Package Outline......................................................................................... 108
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| D38999/26FD15PA | CONN PLUG 15POS STRAIGHT W/PINS |
| D38999/20MC8SN | CONN RCPT 8POS WALL MNT W/SCKT |
| D38999/20MD18SN | CONN RCPT 18POS WALL MNT W/SCKT |
| 0510210700 | CONN HOUSING 7POS 1.25MM |
| ADN8102ACPZ | IC EQUALIZER 4CH XSTREAM 64LFCSP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PI7C8150BMAI | 制造商:PERICOM 制造商全稱:Pericom Semiconductor Corporation 功能描述:ASYNCHRONOUS 2-PORT PCI-TO-PCI BRIDGE |
| PI7C8150BMAI-33 | 制造商:PERICOM 制造商全稱:Pericom Semiconductor Corporation 功能描述:ASYNCHRONOUS 2-PORT PCI-TO-PCI BRIDGE |
| PI7C8150BMAIE | 功能描述:外圍驅(qū)動器與原件 - PCI 2 Port 32B PCI Bridge RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
| PI7C8150BMAIE-33 | 功能描述:外圍驅(qū)動器與原件 - PCI 2 Port 32B PCI Bridge RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
| PI7C8150BND | 功能描述:外圍驅(qū)動器與原件 - PCI 2-Port 32-Bit PCI Bridge RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
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