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參數資料
| 型號： | PM7351-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數字傳輸電路 |
| 英文描述： | OCTAL SERIAL LINK MULTIPLEXER |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA304 |
| 封裝： | 31 X 31 MM, 1.51 MM HEIGHT, 1.27 MM PITCH, SBGA-304 |
| 文件頁數： | 125/174頁 |
| 文件大?。?/td> | 1790K |
| 代理商： | PM7351-BI |
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RELEASED
PM7351 S/UNI-VORTEX
DATA SHEET
PMC-1980582
ISSUE 5
OCTAL SERIAL LINK MULTIPLEXER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
115
2. The cell currently being transferred (or about to be transferred)
over the upstream bus must be from the link being reset. Note
that if several links are active there is no way for software to
determine which link will be providing the next cell to the
upstream bus.
3. The bus master need not have started the cell transfer (in
response to the asserted RPA from the S/UNI-VORTEX) for cell
corruption to occur. The S/UNI-VORTEX uses a partial look
ahead buffer that cannot be reset by the upstream FIFO reset.
Even if the bus master suspends cell transfers during the time
when the upstream FIFO is reset, the next cell read from the
S/UNI-VORTEX will be corrupted if conditions 1 and 2 existed
during the FIFO reset. The simplest approach is to allow the
bus master to continue normal operation during a FIFO reset. If
required, the bus master can discard any cells received from
that link after it is reset.
Reserved:
This bit should be logic 0 for correct operation.
相關PDF資料 |
PDF描述 |
|---|---|
| PM7364 | Frame Engine and Datalink Manager |
| PM7364-BI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366 | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
相關代理商/技術參數 |
參數描述 |
|---|---|
| PM-736 | 制造商:Eclipse Tools 功能描述: |
| PM7364 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7364-BI | 制造商:PMC-Sierra 功能描述:PROTOCOL CONTROLLER, 256 Pin, BGA |
| PM7366 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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