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參數(shù)資料
| 型號： | PM7351-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | OCTAL SERIAL LINK MULTIPLEXER |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA304 |
| 封裝： | 31 X 31 MM, 1.51 MM HEIGHT, 1.27 MM PITCH, SBGA-304 |
| 文件頁數(shù)： | 30/174頁 |
| 文件大?。?/td> | 1790K |
| 代理商： | PM7351-BI |
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RELEASED
PM7351 S/UNI-VORTEX
DATA SHEET
PMC-1980582
ISSUE 5
OCTAL SERIAL LINK MULTIPLEXER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA, INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
20
Ball
Name
Type
Ball
No.
Function
Downstream (Transmit) Bus
TCLK
Input
R21
The transmit FIFO clock (TCLK) is used to transfer
cells from a traffic scheduler device to the internal
downstream cell buffers. TCLK must cycle at a 52
MHz or lower instantaneous rate. TSX, TENB,
TADR[11:0], TPRTY and TDAT[15:0] are sampled on
the rising edge of TCLK. TPA is updated on the rising
edge of TCLK.
TPA
Output
U23
The S/UNI-VORTEX indicates the availability of space
in the FIFO associated with a logical channel when
polled using the TADR[11:0] signals. The S/UNI-
VORTEX will drive the TPA signal to the appropriate
value during the second clock cycle following that in
which a particular logical channel is addressed. When
high, TPA indicates that the corresponding buffer
segment is empty and a complete cell may be written.
The buffer status for the particular logical channel
involved in the transfer is updated immediately upon
sampling the first word of the cell when the
INADDUDF bit of the Downstream Cell Interface
Configuration register is logic 0. When the
INADDUDF bit is logic 1, the buffer status is stale until
nine cycles after the cell transfer is completed;
therefore, the master should refrain from polling that
logical channel in the interim.
TPA becomes high impedance when an address not
matching the address space set by the Control
Channel Base Address, Logical Channel Base
Address and Logical Channel Address Range /
Logical Channel Base Address MSB registers is
sampled from the TADR[11:3] inputs.
TPA is updated on the rising edge of TCLK.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7364 | Frame Engine and Datalink Manager |
| PM7364-BI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366 | FRAME ENGINE AND DATA LINK MANAGER |
| PM7366-BI | TVS BI-DIR 30V 1500W DO-201 |
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM-736 | 制造商:Eclipse Tools 功能描述: |
| PM7364 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7364-BI | 制造商:PMC-Sierra 功能描述:PROTOCOL CONTROLLER, 256 Pin, BGA |
| PM7366 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
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