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參數(shù)資料
| 型號： | STM32W108HBU7 |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC40 |
| 封裝： | 6 X 6 MM, 0.50 MM PITCH, ROHS COMPLIANT, VFQFPN-40 |
| 文件頁數(shù)： | 184/198頁 |
| 文件大?。?/td> | 2871K |
| 代理商： | STM32W108HBU7 |
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Serial interfaces
STM32W108CB, STM32W108HB
Doc ID 16252 Rev 3
9.9.2
SPI configuration register (SCx_SPICFG)
Address offset: 0xC858 (SC1_SPICFG) and 0xC058 (SC2_SPICFG)
Reset value:
0x0000 0000
9.9.3
SPI status register (SCx_SPISTAT)
Address offset: 0xC840 (SC1_SPISTAT) and 0xC040 (SC2_SPISTAT)
Reset value:
0x0000 0000
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Reserved
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3
2
1
0
Reserved
SC_SPI
RXDRV
SC_S
PIMS
T
SC_SP
IRPT
SC_SP
IORD
SC_SP
IPHA
SC_SP
IPOL
rw
Bit 5 SC_SPIRXDRV: Receiver-driven mode selection bit (SPI master mode only). Clear this bit to
initiate transactions when transmit data is available. Set this bit to initiate transactions when the
receive buffer (FIFO or DMA) has space.
Bit 4 SC_SPIMST: Set this bit to put the SPI in master mode, clear this bit to put the SPI in slave
mode.
Bit 3 SC_SPIRPT: This bit controls behavior on a transmit buffer underrun condition in slave mode.
Clear this bit to send the BUSY token (0xFF) and set this bit to repeat the last byte. Changes to
this bit take effect when the transmit FIFO is empty and the transmit serializer is idle.
Bit 2 SC_SPIORD: This bit specifies the bit order in which SPI data is transmitted and received.
0: Most significant bit first.
1: Least significant bit first.
Bit 1 SC_SPIPHA: Clock phase configuration: clear this bit to sample on the leading (first edge) and
set this bit to sample on the second edge.
Bit 0 SC_SPIPOL: Clock polarity configuration: clear this bit for a rising leading edge and set this bit
for a falling leading edge.
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Reserved
SC_SPI
TXIDLE
SC_SPI
TXFREE
SC_SPI
RXVAL
SC_SPI
RXOVF
rr
r
Bit 3 SC_SPITXIDLE: This bit is set when both the transmit FIFO and the transmit serializer are
empty.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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