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參數(shù)資料
| 型號： | V850E1 |
| 廠商： | NEC Corp. |
| 元件分類： | 32位微控制器 |
| 英文描述： | 32-Bit Microprocessor Core |
| 中文描述： | 32位微處理器內(nèi)核 |
| 文件頁數(shù)： | 121/226頁 |
| 文件大小： | 1709K |
| 代理商： | V850E1 |
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APPENDIX B INSTRUCTION LIST
207
User’s Manual U14559EJ3V1UM
Table B-1. Instruction Function List (in Alphabetical Order) (10/11)
Flag
Mnemonic
Operand
Format
CY
OV
S
Z
SAT
Instruction Function
SUB
reg1, reg2
I
0/1
Subtract. Subtracts the word data of reg1 from
the word data of reg2, and stores the result in
reg2.
SUBR
reg1, reg2
I
0/1
Subtract Reverse. Subtracts the word data of
reg2 from the word data of reg1, and stores
the result in reg2.
SWITCH
reg1
I
Jump with Table Look Up. Adds the table entry
address (address following SWITCH
instruction) and data of reg1 logically shifted to
the left by 1 bit, and loads the halfword entry
data specified by the table entry address.
Next, logically shifts to the left by 1 bit the
loaded data, and after sign-extending it to
word length, branches to the target address
added to the table entry address (instruction
following SWITCH instruction).
SXB
reg1
I
Sign Extend Byte. Sign-extends the lowermost
byte of reg1 to word length.
SXH
reg1
I
Sign Extend Halfword. Sign-extends lower
halfword of reg1 to word length.
TRAP
vector
X
Trap. Saves the restored PC and PSW; sets
the exception code and the flags of the PSW;
jumps to the address of the trap handler
corresponding to the trap vector specified by
vector, and starts exception processing.
TST
reg1, reg2
I
0
0/1
Test. ANDs the word data of reg2 with the
word data of reg1. The result is not stored, and
only the flags are changed.
TST1
bit#3, disp16 [reg1]
VIII
0/1
Test Bit. Adds the data of reg1 to a 16-bit
displacement, sign-extended to word length, to
generate a 32-bit address. Performs the test
on the bit, specified by the 3-bit bit number, at
the byte data location referenced by the
generated address. If the specified bit is 0, the
Z flag is set to 1; if the bit is 1, the Z flag is
cleared to 0.
TST1
reg2, [reg1]
IX
0/1
Test Bit. First, reads the data of reg1 to
generate a 32-bit address. If the bits indicated
by the lower 3 bits of reg2 of the byte data of
the generated address are 0, the Z flag is set
to 1, and if they are 1, the Z flag is cleared to
0.
XOR
reg1, reg2
I
0
0/1
Exclusive Or. Exclusively ORs the word data
of reg2 with the word data of reg1, and stores
the result in reg2.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V902-FREQ | VCXO, CLOCK, 65 MHz - 200 MHz, LVDS OUTPUT |
| V903-FREQ | VCXO, CLOCK, 200 MHz - 730 MHz, LVDS OUTPUT |
| VB-24STBU | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-5 | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-E | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| V850E2FK4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850FX3-CANIT | 制造商:NEC Electronics Corporation 功能描述:STARTER KIT 32BIT CAN |
| V850R3 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
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