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參數(shù)資料
| 型號： | V850E1 |
| 廠商： | NEC Corp. |
| 元件分類： | 32位微控制器 |
| 英文描述： | 32-Bit Microprocessor Core |
| 中文描述： | 32位微處理器內(nèi)核 |
| 文件頁數(shù)： | 141/226頁 |
| 文件大小： | 1709K |
| 代理商： | V850E1 |
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APPENDIX G REVISION HISTORY
225
User’s Manual U14559EJ3V1UM
G.2 History of Revisions up to This Edition
A history of the revisions up to this edition is shown below. “Applied to:” indicates the chapters to which the revision
was applied.
(1/2)
Edition
Major Revision from Previous Edition
Applied to:
Addition of following products (under development) to target products
NB85ET, NU85E, NU85ET,
PD703108, 703114, 70F3114, 703116
Deletion of following product from target products
PD703117
Change of following products from “under development” to “developed”
PD703106, 703107, 70F3107
Throughout
Change of Note in Figure 2-1 Registers
Change of Table 2-2 System Register Numbers
Addition of Note to Figure 2-6 Program Status Word (PSW)
Addition of Note to 2.2.6 Exception/debug trap status saving registers (DBPC, DBPSW)
Change of Caution in 2.2.8 Debug interface register (DIR)
Change of Caution in 2.2.9 Breakpoint control registers 0 and 1 (BPC0, BPC1)
Change of Figure 2-11 Breakpoint Control Registers 0 and 1 (BPC0, BPC1)
Change of Caution in 2.2.10 Program ID register (ASID)
Change of Caution in 2.2.11 Breakpoint address setting registers 0 and 1 (BPAV0, BPAV1)
Change of Caution in 2.2.12 Breakpoint address mask registers 0 and 1 (BPAM0, BPAM1)
Change of Caution in 2.2.13 Breakpoint data setting registers 0 and 1 (BPDV0, BPDV1)
Change of Caution in 2.2.14 Breakpoint data mask registers 0 and 1 (BPDM0, BPDM1)
CHAPTER 2
REGISTER SET
Addition of Caution to 5.2 (10) Debug function instructions
Addition of Caution to DBRET in 5.3 Instruction Set
Addition of Caution to DBTRAP in 5.3 Instruction Set
Change and addition of Note in Table 5-6 List of Number of Instruction Execution Clock
Cycles (NB85E, NB85ET, NU85E, and NU85ET)
Change of Note in Table 5-7 List of Number of Instruction Execution Clock Cycles
(V850E/MA1, V850E/MA2, V850E/IA1, and V850E/IA2)
CHAPTER 5
INSTRUCTION
Addition of Note to Table 6-1 Interrupt/Exception Codes
Addition of Caution to 6.2.3 Debug trap
CHAPTER 6
INTERRUPT AND
EXCEPTION
Addition of Remark and Example to 8.1.2 2-clock branch
Addition of Caution to 8.1.3 Efficient pipeline processing
Correction of description in 8.2 (2) V850E/MA1, V850E/MA2, V850E/IA1, V850E/IA2
Correction of description in 8.2.1 (2) SLD instructions
Correction of description in 8.2.3 Multiply instructions
Addition of Remark to 8.2.4 (3) Divide instructions
Correction of description in 8.2.8 (2) TST1 instruction
Addition of Remark to 8.2.9 (3) DI, EI instructions
2nd
Addition of Caution to 8.2.9 (7) NOP instruction
CHAPTER 8
PIPELINE
相關PDF資料 |
PDF描述 |
|---|---|
| V902-FREQ | VCXO, CLOCK, 65 MHz - 200 MHz, LVDS OUTPUT |
| V903-FREQ | VCXO, CLOCK, 200 MHz - 730 MHz, LVDS OUTPUT |
| VB-24STBU | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-5 | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-E | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| V850E2FK4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850FX3-CANIT | 制造商:NEC Electronics Corporation 功能描述:STARTER KIT 32BIT CAN |
| V850R3 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
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