參數(shù)資料
型號： V850E1
廠商： NEC Corp.
元件分類： 32位微控制器
英文描述： 32-Bit Microprocessor Core
中文描述： 32位微處理器內(nèi)核
文件頁數(shù)： 138/226頁
文件大?。?/td> 1709K
代理商： V850E1
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APPENDIX F INDEX
222
User’s Manual U14559EJ3V1UM
EIPC ........................................................................ 19
EIPSW .................................................................... 19
EI instruction (pipeline) .......................................... 177
Exception cause register ......................................... 20
Exception/debug trap status saving registers .......... 24
Exception processing ............................................ 159
Exception trap ....................................................... 160
Extended instruction format 1 .................................. 45
Extended instruction format 2 .................................. 46
Extended instruction format 3 .................................. 46
Extended instruction format 4 .................................. 46
[F]
FEPC ...................................................................... 20
FEPSW ................................................................... 20
Format I ................................................................... 43
Format II .................................................................. 43
Format III ................................................................. 44
Format IV ................................................................ 44
Format V ................................................................. 44
Format VI ................................................................ 45
Format VII ............................................................... 45
Format VIII .............................................................. 45
Format IX ................................................................ 45
Format X ................................................................. 46
Format XI ................................................................ 46
Format XII ............................................................... 46
Format XIII .............................................................. 46
[G]
General-purpose registers ....................................... 16
[H]
Halfword .................................................................. 34
HALT ....................................................................... 77
HALT instruction (pipeline) .................................... 178
Harvard architecture .............................................. 186
How to shift to debug mode.................................... 189
HSW ........................................................................ 78
[I]
imm-reg instruction format ....................................... 43
Immediate addressing ............................................. 41
Instruction address .................................................. 39
Instruction format .................................................... 43
Instruction opcode map ......................................... 211
Instruction set .......................................................... 51
Integer ..................................................................... 35
Internal configuration ............................................... 15
Interrupt servicing .................................................. 156
Interrupt status saving registers .............................. 19
[J]
JARL ....................................................................... 79
JMP ........................................................................ 80
JMP instruction (pipeline) ...................................... 175
JR ........................................................................... 81
Jump instruction format .......................................... 44
[L]
LD instructions ........................................................ 47
LD instructions (pipeline) ...................................... 171
LD.B ........................................................................ 82
LD.BU ..................................................................... 83
LD.H ....................................................................... 84
LD.HU ..................................................................... 86
LD.W ....................................................................... 88
LDSR ...................................................................... 90
LDSR instruction (pipeline) ................................... 178
Load instructions ..................................................... 47
Load instructions (pipeline) ................................... 171
Logical operation instructions ................................. 48
Logical operation instructions (pipeline) ................ 174
[M]
Maskable interrupt ................................................ 156
Memory map ........................................................... 38
MOV ....................................................................... 91
MOVEA ................................................................... 92
Move word instruction (pipeline) ........................... 173
MOVHI .................................................................... 93
MUL ........................................................................ 94
MULH ..................................................................... 96
MULHI .................................................................... 97
Multiply instructions ................................................ 47
Multiply instructions (pipeline) ............................... 172
MULU ..................................................................... 98
[N]
NMI status saving registers .................................... 20
Non-blocking load/store ......................................... 168
Non-maskable interrupt ........................................ 158
NOP ...................................................................... 100
NOP instruction (pipeline) ..................................... 179
NOT ...................................................................... 101
NOT1 .................................................................... 102
NOT1 instruction (pipeline) ................................... 176
[O]
Operand address .................................................... 41
OR ........................................................................ 103
ORI ....................................................................... 104
相關(guān)PDF資料
PDF描述
V902-FREQ VCXO, CLOCK, 65 MHz - 200 MHz, LVDS OUTPUT
V903-FREQ VCXO, CLOCK, 200 MHz - 730 MHz, LVDS OUTPUT
VB-24STBU POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT
VB-24STCU-5 POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT
VB-24STCU-E POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
V850E2FK4-H 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller
V850E2FL4 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller
V850E2FL4-H 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller
V850FX3-CANIT 制造商:NEC Electronics Corporation 功能描述:STARTER KIT 32BIT CAN
V850R3 制造商:未知廠家 制造商全稱:未知廠家 功能描述:
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