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參數(shù)資料
| 型號： | V850E1 |
| 廠商： | NEC Corp. |
| 元件分類： | 32位微控制器 |
| 英文描述： | 32-Bit Microprocessor Core |
| 中文描述： | 32位微處理器內(nèi)核 |
| 文件頁數(shù)： | 144/226頁 |
| 文件大?。?/td> | 1709K |
| 代理商： | V850E1 |
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CHAPTER 2 REGISTER SET
User’s Manual U14559EJ3V1UM
24
2.2.6 Exception/debug trap status saving registers (DBPC, DBPSW)
Two exception/debug trap status saving registers are provided: DBPC and DBPSW.
When an exception trap, debug trap
Note, or debug break occurs or during a single-step operation, the contents of the
program counter (PC) are saved to DBPC, and the contents of the program status word (PSW) are saved to DBPSW.
The contents to be saved to DBPC are as follows.
Table 2-3. Contents to Be Saved to DBPC
Cause for Saving
Contents Saved to DBPC
Occurrence of exception trap
Address of the instruction next to the instruction that caused an
exception trap
Occurrence of debug trap
Address of the instruction next to the instruction that caused a debug
trap
Execution trap
Misalign access exception
Alignment error exception
Address of the instruction that caused a break
Occurrence of debug break
Access trap
Address of the instruction next to the instruction that caused a break
Single-step operation execution
Address of the instruction to be executed next (instruction executed
when restoring from the debug monitor routine)
Remark
For details of causes for saving, refer to CHAPTER 9 SHIFTING TO DEBUG MODE.
The current value of the PSW is saved to DBPSW.
Reading from this register is enabled only in debug mode (DIR.DM bit = 1) (writing to this register is always
enabled). If this register is read in user mode (DM bit = 0), an undefined value is read.
Bits 31 to 26 of DBPC and bits 31 to 12 and 10 to 8 of DBPSW are reserved for future function expansion (fixed to
0).
Note Type C products do not support a debug trap.
Figure 2-8. Exception/Debug Trap Status Saving Registers (DBPC, DBPSW)
31
26 25
0
DBPC
(Contents of PC)
31
DBPSW
0 0 0 0 0 0
0 0 0 0 0
0
(Contents of PSW)
0
8
11
0 0
Note
9
10
12
Initial value
0xxxxxxxH
(x: Undefined)
00000xxxH
0
Initial value
(x: Undefined)
7
Note Contents of SS flag in PSW
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V902-FREQ | VCXO, CLOCK, 65 MHz - 200 MHz, LVDS OUTPUT |
| V903-FREQ | VCXO, CLOCK, 200 MHz - 730 MHz, LVDS OUTPUT |
| VB-24STBU | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-5 | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
| VB-24STCU-E | POWER/SIGNAL RELAY, DPDT, MOMENTARY, 0.022A (COIL), 24VDC (COIL), 530mW (COIL), 5A (CONTACT), 150VDC (CONTACT), THROUGH HOLE-STRAIGHT MOUNT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| V850E2FK4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4 | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850E2FL4-H | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:32-bit Single-Chip Microcontroller |
| V850FX3-CANIT | 制造商:NEC Electronics Corporation 功能描述:STARTER KIT 32BIT CAN |
| V850R3 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述: |
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