參數(shù)資料
型號: XRT72L50IQ
廠商: EXAR CORP
元件分類: 數(shù)字傳輸電路
英文描述: Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述: DATACOM, FRAMER, PQFP100
封裝: 14 X 20 MM, PLASTIC, QFP-100
文件頁數(shù): 364/471頁
文件大?。?/td> 2424K
代理商: XRT72L50IQ
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XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER WITH HDLC CONTROLLER
REV. 1.2.1
á
351
C. Delineation of Outbound E3 frames (Frame Master Mode)
The Transmit Section of the XRT72L50 will use the TxInClk signal as its timing reference, and will initiate E3
frame generation, asynchronously with respect to any externally applied signal. The XRT72L50 will pulse its
TxFrame output pin "High" whenever it is processing the very last bit-field within a given E3 frame.
D. Sampling of payload data, from the Terminal Equipment
In Mode 3, the XRT72L50 will sample the data, at the TxSer input pin, on the rising edge of TxInClk.
Interfacing the Transmit Payload Data Input Interface block of the XRT72L50 to the Terminal Equipment
for Mode 3 Operation
Figure 149
presents an illustration of the Transmit Payload Data Input Interface block (within the XRT72L50)
being interfaced to the Terminal Equipment, for Mode 3 operation.
Mode 3 Operation of the Terminal Equipment
In
Figure 149
, both the Terminal Equipment and the XRT72L50 are driven by an external 34.368 MHz clock
signal. This clock signal is connected to the E3_Clock_In input of the Terminal Equipment and the TxInClk
input pin of the XRT72L50.
The Terminal Equipment will serially output the payload data on its E3_Data_Out output pin, upon the rising
edge of the signal at the E3_Clock_In input pin. Similarly, the XRT72L50 will latch the data, residing on the
TxSer input pin, on the rising edge of TxInClk.
The XRT72L50 will pulse the TxFrame output pin "High" for one bit-period, coincident while it is processing the
last bit-field within a given Outbound E3 frame. The Terminal Equipment is expected to monitor the TxFrame
signal (from the XRT72L50) and to place the first bit, within the very next Outbound E3 frame on the TxSer
input pin.
N
OTE
:
In this case, the XRT72L50 dictates exactly when the very next E3 frame will be generated. The Terminal
Equipment is expected to respond appropriately by providing the XRT72L50 with the first bit of the new E3 frame,
upon demand. Hence, in this mode, the XRT72L50 is referred to as the Frame Master and the Terminal Equipment
is referred to as the Frame Slave.
Finally, the XRT72L50 will pulse its TxOH_Ind output pin, one bit-period prior to it processing a given overhead
bit, within the Outbound E3 frame. Since the TxOH_Ind output pin of the XRT72L50 is electrically connected to
the E3_Overhead_Ind whenever the XRT72L50 pulses the TxOH_Ind output pin "High", it will also be driving
the E3_Overhead_Ind input pin (of the Terminal Equipment) "High". Whenever the Terminal Equipment
F
IGURE
149. T
HE
T
ERMINAL
E
QUIPMENT
BEING
INTERFACED
TO
THE
T
RANSMIT
P
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NPUT
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NTERFACE
BLOCK
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3 (S
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/L
OCAL
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IMED
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RAME
-M
ASTER
) O
PERATION
E3_Clock_In
E3_Data_Out
Tx_Start_of_Frame
E3_Overhead_Ind
TxInClk
TxSer
TxFrame
TxOH_Ind
NibIntf
Terminal Equipment
E3 Framer
34.368MHz
Clock Source
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PDF描述
XRT72L50 Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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參數(shù)描述
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XRT72L50IQTR-F 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L52 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
XRT72L52ES-PCI 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流(最大值):595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
XRT72L52IQ 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER