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參數(shù)資料
| 型號： | 7540 |
| 英文描述： | 250MA CMOS LDO, ISUPPLY 1UA & 2% VOUT ACCURACY, -40C to +125C, 3-SOT-89, T/R |
| 中文描述： | 7540群用戶手冊數(shù)據(jù)4267K/MAY.28.03 |
| 文件頁數(shù)： | 64/365頁 |
| 文件大?。?/td> | 4267K |
| 代理商： | 7540 |
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HARDWARE
1-46
7540 Group User
’
s Manual
G
Oscillation stop detection circuit (Note)
The oscillation stop detection circuit is used for reset occurrence
when a ceramic resonator or an oscillation circuit stops by discon-
nection. When internal reset occurs, reset because of oscillation
stop can be detected by setting
“
1
”
to the oscillation stop detection
status bit.
Also, when using the oscillation stop detection circuit, a built-in
ring oscillator is required.
Figure 53 shows the state transition.
Note:
The oscillation stop detection circuit is not included in the
emulator MCU
“
M37540RSS
”
.
Fig. 50 Structure of MISRG
MISRG(address 0038
16
, initial value: 00
16
)
b7 b0
Oscillation stabilization time set bit after
release of the STP instruction
0: Set
“
01
16
”
in timer1, and
“
FF
16
”
in prescaler 1 automatically
1: Not set automatically
Ceramic or RC oscillation stop detection
function active bit
0: Detection function inactive
1: Detection function active
Reserved bits (return
“
0
”
when read)
(Do not write
“
1
”
to these bits)
Not used (return
“
0
”
when read)
Oscillation stop detection status bit
0: Oscillation stop not detected
1: Oscillation stop detected
(1) Oscillation control
Stop mode
When the STP instruction is executed, the internal clock
φ
stops at
an
“
H
”
level and the X
IN
oscillator stops. At this time, timer 1 is set
to
“
01
16
”
and prescaler 1 is set to
“
FF
16
”
when the oscillation sta-
bilization time set bit after release of the STP instruction is
“
0
”
. On
the other hand, timer 1 and prescaler 1 are not set when the
above bit is
“
1
”
. Accordingly, set the wait time fit for the oscillation
stabilization time of the oscillator to be used. f(X
IN
)/16 is forcibly
connected to the input of prescaler 1. When an external interrupt
is accepted, oscillation is restarted but the internal clock
φ
remains
at
“
H
”
until timer 1 underflows. As soon as timer 1 underflows, the
internal clock
φ
is supplied. This is because when a ceramic oscil-
lator is used, some time is required until a start of oscillation. In
case oscillation is restarted by reset, no wait time is generated. So
apply an
“
L
”
level to the RESET pin while oscillation becomes
stable.
Also, the STP instruction cannot be used while CPU is operating
by a ring oscillator.
Wait mode
If the WIT instruction is executed, the internal clock
φ
stops at an
“
H
”
level, but the oscillator does not stop. The internal clock re-
starts if a reset occurs or when an interrupt is received. Since the
oscillator does not stop, normal operation can be started immedi-
ately after the clock is restarted. To ensure that interrupts will be
received to release the STP or WIT state, interrupt enable bits
must be set to
“
1
”
before the STP or WIT instruction is executed.
I
Notes on clock generating circuit
For use with the oscillation stabilization set bit after release of the
STP instruction set to
“
1
”
, set values in timer 1 and prescaler 1 af-
ter fully appreciating the oscillation stabilization time of the
oscillator to be used.
Switch of ceramic and RC oscillations
After releasing reset the operation starts by starting a built-in ring
oscillator. Then, a ceramic oscillation or an RC oscillation is se-
lected by setting bit 5 of the CPU mode register.
Double-speed mode
When a ceramic oscillation is selected, a double-speed mode can
be used. Do not use it when an RC oscillation is selected.
CPU mode register
Bits 5, 1 and 0 of CPU mode register are used to select oscillation
mode and to control operation modes of the microcomputer. In or-
der to prevent the dead-lock by error-writing (ex. program
run-away), these bits can be rewritten only once after releasing re-
set. After rewriting it is disable to write any data to the bit. (The
emulator MCU
“
M37540RSS
”
is excluded.)
Also, when the read-modify-write instructions (SEB, CLB) are ex-
ecuted to bits 2 to 4, 6 and 7, bits 5, 1 and 0 are locked.
Clock division ratio, X
IN
oscillation control, ring oscillator control
The state transition shown in Fig. 52 can be performed by setting
the clock division ratio selection bits (bits 7 and 6), X
IN
oscillation
control bit (bit 4), ring oscillator oscillation control bit (bit 3) of CPU
mode register. Be careful of notes on use in Fig. 52.
FUNCTIONAL DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 7542 | 250mA CMOS LDO, lsupply 1uA and 2% Vout Accuracy, -40C to +125C, 3-SOT-23, T/R |
| 7544 | 3.3V LDO POSITVE VOLTAGE REGULATOR 2% TOL. |
| 75450PC | Peripheral IC |
| D122D | Converter IC |
| D347D | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 7540_M | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:8-BIT CISC SINGLE-CHIP MICROCOMPUTER 740 FAMILY / 740 SERIES |
| 75400 | 制造商:Honeywell Sensing and Control 功能描述: |
| 7-5-4004 | 功能描述:3M 4004 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4004 零件狀態(tài):在售 標準包裝:1 |
| 7-5-4008 | 功能描述:3M 4008 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4008 零件狀態(tài):在售 標準包裝:1 |
| 754010 | 制造商: 功能描述: 制造商:undefined 功能描述: |
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