參數(shù)資料
型號(hào)： 82801BAICH2
英文描述： PERIPHERAL (MULTIFUNCTION) CONTROLLER
中文描述： 周邊（多功能）控制器
文件頁(yè)數(shù)： 302/462頁(yè)
文件大?。?/td> 3450K
代理商： 82801BAICH2
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LPC Interface Bridge Registers (D31:F0)
9-56
Intel
82801BA ICH2 Datasheet
9.8.1.4
GPI_ROUT—GPI Routing Control Register (PM—D31:F0)
Offset Address:
Default Value:
Lockable:
B8h–BBh
0000h
No
Attribute:
Size:
Power Well:
R/W
32-bit
Resume
Note:
GPIOs that are not implemented will not have the corresponding bits implemented in this register.
9.8.1.5
TRP_FWD_EN—IO Monitor Trap Forwarding Enable Register
(PM—D31:F0)
Offset Address:
Default Value:
Lockable:
Power Well:
C0h
00h
No
Core
Attribute:
Size:
Usage:
R/W (Special)
8 bits
Legacy Only
The ICH2 uses this register to enable the monitors to forward cycles to LPC, independent of the
POS_DEC_EN bit and the bits that enable the monitor to generate an SMI#. The only criteria is
that the address passes the decoding logic as determined by the MON[
n
]_TRP_RNG and
MON_TRP_MSK register settings.
Bit
Description
31:30
GPI[15] Route
—R/W. See bits 1:0 for description.
Same pattern for GPI[14] through GPI[3]
5:4
GPI[2] Route
—R/W. See bits 1:0 for description.
3:2
GPI[1] Route
—R/W. See bits 1:0 for description.
1:0
GPI[0] Route
—R/W. GPIO[13:11,8:6,4:3,1:0] can be routed to cause an SMI or SCI when the
GPI[n]_STS bit is set. If the GPIO is not set to an input, this field has no effect.
If the system is in an S1–S5 state and if the GPE1_EN bit is also set, then the GPI can cause a
Wake event, even if the GPI is NOT routed to cause an SMI# or SCI.
00 = No effect.
01 = SMI# (if corresponding GPE1_EN bit is also set)
10 = SCI (if corresponding GPE1_EN bit is also set)
11 = Reserved
Bit
Description
7
Monitor 7 Forward Enable (MON7_FWD_EN
)—R/W.
0 = Disable. Cycles trapped by I/O Monitor 7 will not be forwarded to LPC.
1 = Enable. Cycles trapped by I/O Monitor 7 will be forwarded to LPC.
6
Monitor 6 Forward Enable (MON6_FWD_EN
)—R/W.
0 = Disable. Cycles trapped by I/O Monitor 6 will not be forwarded to LPC.
1 = Enable. Cycles trapped by I/O Monitor 6 will be forwarded to LPC.
5
Monitor 5 Forward Enable (MON5_FWD_EN
)—R/W.
0 = Disable. Cycles trapped by I/O Monitor 5 will not be forwarded to LPC.
1 = Enable. Cycles trapped by I/O Monitor 5 will be forwarded to LPC.
4
Monitor 4 Forward Enable (MON4_FWD_EN
)—R/W.
0 = Disable. Cycles trapped by I/O Monitor 4 will not be forwarded to LPC.
1 = Enable. Cycles trapped by I/O Monitor 4 will be forwarded to LPC.
3:0
Reserved.
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相關(guān)PDF資料
PDF描述
82801FB Intel I/O Controller Hub 6 (ICH6) Family
82801FBM Intel I/O Controller Hub 6 (ICH6) Family
82801FR Intel I/O Controller Hub 6 (ICH6) Family
82801DB Intel 82801DB I/O Controller Hub 4 (ICH4)
82801AA 82801AB (ICH0) I/O Controller Hub
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
82801DB 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel 82801DB I/O Controller Hub 4 (ICH4)
82801E 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel 82801E Communications I/O Controller Hub (C-ICH)
82801FB 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
82801FBM 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
82801FR 制造商:INTEL 制造商全稱(chēng):Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
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