參數(shù)資料
型號(hào)： 82801BAICH2
英文描述： PERIPHERAL (MULTIFUNCTION) CONTROLLER
中文描述： 周邊（多功能）控制器
文件頁(yè)數(shù)： 316/462頁(yè)
文件大小： 3450K
代理商： 82801BAICH2
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LPC Interface Bridge Registers (D31:F0)
9-70
Intel
82801BA ICH2 Datasheet
9.8.3.12
SMI_STS—SMI Status Register
I/O Address:
Default Value:
Lockable:
Power Well:
PMBASE + 34h
0000h
No
Core
Attribute:
Size:
Usage:
R/W
32-bit
ACPI or Legacy
Note:
If the corresponding _EN bit is set when the _STS bit is set, the ICH2 will cause an SMI# (except
bits 8:10 and 12, which do not need enable bits since they are logic ORs of other registers that have
enable bits).
Bit
Description
31:17
Reserved
16
SMBus SMI Status (SMBUS_SMI_STS)
—R/WC.
1 = Indicates that the SMI# was caused by either the SMBus Slave receiving a message, or the
SMBALERT# signal going active. This bit will be set on SMBALERT# assertion only if the
SMBus Host Controller is programmed to generate SMIs (not interrupts).
0 = This bit is cleared by writing a 1 to its bit position.
15
SERR IRQ SMI Status (SERIRQ_SMI_STS)
—RO.
1 = Indicates that the SMI# was caused by the SERIRQ decoder.
0 = SMI# was not caused by SERIRQ decoder. This is not a sticky bit.
14
Periodic Status (PERIODIC_STS)
—R/WC.
1 = This bit will be set at the rate determined by the PER_SMI_SEL bits. If the PERIODIC_EN bit is
also set, the ICH2 will generate an SMI#.
0 = This bit is cleared by writing a 1 to its bit position.
13
TCO Status (TCO_STS)
—RO.
0 = SMI# not caused by TCO logic.
1 = Indicates the SMI# was caused by the TCO logic. Note that this is not a wake event.
12
Device Monitor Status (DEVMON_STS)
—RO.
1 = Set under any of the following conditions:
-
Any of the DEV[7:4]_TRAP_STS bits are set and the corresponding DEV[7:4]_TRAP_EN bits
are also set.
-
Any of the DEVTRAP_STS bits are set and the corresponding DEVTRAP_EN bits are also set.
0 = SMI# not caused by Device Monitor.
11
Microcontroller SMI# Status (MCSMI_STS)
—R/WC.
0 = Indicates that there has been no access to the power management microcontroller range (62h or
66h). This bit is cleared by software writing a 1 to the bit position.
1 = Set if there has been an access to the power management microcontroller range (62h or 66h). If
this bit is set, and the MCSMI_EN bit is also set, the ICH2 will generate an SMI#.
10
GPE1 Status (GPE1_STS
)—RO.
This bit is a logical OR of the bits in the GPE1_STS register that
are also set up to cause an SMI# (as indicated by the GPI_ROUT registers) and have the
corresponding bit set in the GPE1_EN register. Bits that are not routed to cause an SMI# will have no
effect on the GPE1_STS bit.
0 = SMI# was not generated by a GPI assertion.
1 = SMI# was generated by a GPI assertion.
9
GPE0 Status (GPE0_STS)
—RO.
This bit is a logical OR of the bits in the GPE0_STS register that
also have the corresponding bit set in the GPE0_EN register.
0 = SMI# was not generated by a GPE0 event.
1 = SMI# was generated by a GPE0 event.
8
PM1 Status Register (PM1_STS_REG)
—RO.
This is an OR of the bits in the ACPI PM1 Status
Register (offset PMBASE+00h) that can cause an SMI#.
0 = SMI# was not generated by a PM1_STS event.
1 = SMI# was generated by a PM1_STS event.
7
Reserved.
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PDF描述
82801FB Intel I/O Controller Hub 6 (ICH6) Family
82801FBM Intel I/O Controller Hub 6 (ICH6) Family
82801FR Intel I/O Controller Hub 6 (ICH6) Family
82801DB Intel 82801DB I/O Controller Hub 4 (ICH4)
82801AA 82801AB (ICH0) I/O Controller Hub
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
82801DB 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel 82801DB I/O Controller Hub 4 (ICH4)
82801E 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel 82801E Communications I/O Controller Hub (C-ICH)
82801FB 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
82801FBM 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
82801FR 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family
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