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參數(shù)資料
| 型號： | 82C836A-20 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Single-Chip 386sx AT |
| 中文描述： | 單芯片386sx在 |
| 文件頁數(shù)： | 130/205頁 |
| 文件大?。?/td> | 3878K |
| 代理商： | 82C836A-20 |
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Port 61H controls several system-level functions. The port can be accessed through any
odd I/O port address from 61H through 6FH.
Table 10-23.
Port 61H----Control Port/Status
Bit
Name
Description
7
Parity Error
(read only)
This bit (if 1) indicates that a parity error has been detected during a local
memory read. Causes NMI if Port 70H bit 7 is 0.
6
IOCHCK
(read only)
This bit (if 1) indicates an I/O channel check has occured (usually a parity
error) on the system I/O channel. Causes NMI if port 70H bit 7 is 0.
5
TMR 2 Out
(read only)
This bit returns the condition of the timer 2 output (speaker tone).
4
Refresh Detect
(read only)
This bit toggles on each refresh cycle.
3
CHCK DIS
(read/write)
This bit clears and disables the internal I/O Channel Check detection latch.
1 = Latch clear and disable. Bit 6 still responds to IOCHCK
(unlatched) but does not cause NMI.
0 = Enable I/O Channel Check detection.
2
Parity Disable
(read/write)
This bit, if set, clears and disables the internal parity error detection latch.
1 = Parity error latch clear and disable.
0 = Parity checking enable (default), if ICR 46H bit 6 is also zero.
1
SPKR Data
(read/write)
This bit gates the output of channel 2 of the timer/counter (speaker tone).
1 = Output is enabled, i.e., speaker tone on.
0 = Output is forced low (default)
0
TMR 2 Gate
(read/write)
This bit gates the clock input for timer channel 2 (speaker tone).
1 = Channel 2 timer clock enabled.
0 = Channel 2 timer clock disabled (default).
I
Configuration Registers
82C386 CHIPSet Data Sheet
10-18
Revision 3.0
P R E L I M I N A R Y
Chips and Technologies, Inc.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82C836B | Single-Chip 386sx AT |
| 82C862 | FireLink USB Dual Controller Quad Port USB |
| 82C931 | Plug and Play Integrated Audio Controller |
| 82S09 | 576-BIT BIPOLAR RAM (64 X 9) |
| 82S19 | 576-BIT BIPOLAR RAM (64 X 9) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82C836B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Single-Chip 386sx AT |
| 82C83H | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS Octal Latching Inverting Bus Driver |
| 82C84 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS Clock Generator Driver |
| 82C84A | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS Clock Generator Driver |
| 82C84A/B | 制造商: 功能描述: 制造商:undefined 功能描述: |
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