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參數(shù)資料
| 型號： | A42MX16-3BG100 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 40MX and 42MX FPGA Families |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁數(shù)： | 82/120頁 |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX16-3BG100 |
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64
4958B–AUTO–11/10
Atmel ATA6285/ATA6286 [Preliminary]
Table 3-26 relates the alternate functions of Port C to the overriding signals shown in Table 3-21
3.12.3.4
Alternate Functions of Port D
The Port D pins with alternate function are shown in Table 3-27.
Table 3-26.
Overriding Signals for Alternate Functions in PC2..PC0
Signal Name
PC2/PCINT10
PC1/CLKO/PCINT9
PC0/EXIN0/PCINT8
PUOE
CLKO
PUOV
0
DDOE
CLKO(1)
CMM[1..0]
× NECINS× CSS
DDOV
1
0
PVOE
CLKO(1)
0
PVOV
CLK
I/O
0
DIEOE
PCINT10
× PCIE1
PCINT9
× PCIE1
PCINT8
× PCIE1
DIEOV
1
DI
PCINT10 INPUT
PCINT9 INPUT
CLOCK OUTPUT
PCINT8 INPUT
EXIN0 INPUT
AIO
Sensor input 4
Oscillator output
Oscillator input
Note:
1. CLKO is one if the CKOUT fuse is programmed.
Table 3-27.
Port D Pins Alternate Functions
Port Pin
Alternate Functions
PD7
SDIN (Timer2 SSI serial input data input)
PCINT23 (Pin Change Interrupt 23)
PD6
T2O2 (Timer2 output 2)
PCINT22 (Pin Change Interrupt 22)
PD5
T2O1 (Timer2 output 1)
PCINT21 (Pin Change Interrupt 21)
PD4
ECIN1 (External system input clock 1 input)
PCINT20 (Pin Change Interrupt 20)
PD3
INT1 (External input interrupt 1 input)
PCINT19 (Pin Change Interrupt 19)
PD2
INT0 (External input interrupt 0 input)
PCINT18 (Pin Change Interrupt 18)
PD1
T3I (Timer1, Timer2, Timer3 external input clock input)
PCINT17 (Pin Change Interrupt 17)
PD0
T2ICP (Timer2 external input capture input)
PCINT16 (Pin Change Interrupt 16)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A42MX16-3PL100 | 40MX and 42MX FPGA Families |
| A42MX16-3PL100A | 40MX and 42MX FPGA Families |
| A42MX16-3PQ100A | 40MX and 42MX FPGA Families |
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| A42MX16-3VQ100A | 40MX and 42MX FPGA Families |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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