Asynchronous Read/Write—Host to ADSP-21160M Use these specifications (Table 14 and Table 15) for asyn- chronous host pr" />
參數(shù)資料
型號： ADSP-21160MKBZ-80
廠商： Analog Devices Inc
文件頁數(shù)： 21/52頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 32BIT 400 BGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點
接口： 主機接口，連接端口，串行端口
時鐘速率： 80MHz
非易失內(nèi)存： 外部
芯片上RAM： 512kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤
ADSP-21160M
–28–
REV. 0
Asynchronous Read/Write—Host to ADSP-21160M
Use these specifications (Table 14 and Table 15) for asyn-
chronous host processor accesses of an ADSP-21160M,
after the host has asserted CS and HBR (low). After HBG
is returned by the ADSP-21160M, the host can drive the
RDx and WRx pins to access the ADSP-21160M’s internal
memory or IOP registers. HBR and HBG are assumed low
for this timing
Table 14. Read Cycle
Parameter
Min
Max
Unit
Timing Requirements:
t
SADRDL
Address Setup/CS Low Before RDx Low
0
ns
t
HADRDH
Address Hold/CS Hold Low After RDx
2ns
t
WRWH
RDx/WRx High Width
5ns
t
DRDHRDY
RDx High Delay After REDY (O/D) Disable
0ns
t
DRDHRDY
RDx High Delay After REDY (A/D) Disable
0ns
Switching Characteristics:
t
SDATRDY
Data Valid Before REDY Disable from Low
2
ns
t
DRDYRDL
REDY (O/D) or (A/D) Low Delay After RDx Low
10
ns
t
RDYPRD
REDY (O/D) or (A/D) Low Pulsewidth for Read
t
CK
ns
t
HDARWH
Data Disable After RDx High
26ns
Figure 20. Read Cycle (Asynchronous Read—Host to ADSP-21160M)
5( $ ' & < & /(
5('< 2'
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W:5:+
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W+'$5:+
W5'<35'
W'5'+5'<
W6'$75'<
相關(guān)PDF資料
PDF描述
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ADSP-21160NCE-100 制造商:Analog Devices 功能描述:
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