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參數(shù)資料
| 型號： | EP1S30F780I6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 732/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 30K LE 780-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標(biāo)準(zhǔn)包裝： | 18 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 3247 |
| 邏輯元件/單元數(shù)： | 32470 |
| RAM 位總計： | 3317184 |
| 輸入/輸出數(shù)： | 597 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 780-BBGA |
| 供應(yīng)商設(shè)備封裝： | 780-FBGA（29x29） |
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11–40
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
Configuration Schemes
JTAG-chain device programming is ideal when the PCB contains multiple
devices, or when testing the PCB using JTAG BST circuitry. Figure 11–21
shows multi-device JTAG configuration.
Notes to Figure 11–21:
(1)
Stratix, Stratix GX, APEXTM II, APEX 20K, MercuryTM, ACEX 1K, and FLEX 10K devices can be placed within the
same JTAG chain for device programming and configuration.
(2)
For more information on all configuration pins connected in this mode, see Table 11–11 on page 11–37.
(3)
Connect the nCONFIG, MSEL0, MSEL1, and MSEL2 pins to support a non-JTAG configuration scheme. If only JTAG
configuration is used, connect nCONFIG to VCC, and MSEL0, MSEL1, and MSEL2 to ground. Pull DATA0 and DCLK
to either high or low.
(4)
VIO is a reference voltage for the MasterBlaster output driver. VIO should match the device’s VCCIO. See the
MasterBlaster Serial/USB Communications Cable Data Sheet for this value.
(5)
nCE
must be connected to GND or driven low for successful JTAG configuration.
The nCE pin must be connected to GND or driven low during JTAG
configuration. In multi-device PS, FPP and PPA configuration chains, the
first device's nCE pin is connected to GND while its nCEO pin is connected
to nCE of the next device in the chain. The last device's nCE input comes
from the previous device, while its nCEO pin is left floating. After the first
device completes configuration in a multi-device configuration chain, its
nCEO
pin drives low to activate the second device's nCE pin, which
prompts the second device to begin configuration. Therefore, if these
devices are also in a JTAG chain, you should make sure the nCE pins are
connected to GND during JTAG configuration or that the devices are JTAG
configured in the same order as the configuration chain. As long as the
devices are JTAG configured in the same order as the multi-device
configuration chain, the nCEO of the previous device drives nCE of the
next device low when it has successfully been JTAG configured.
TMS
TCK
MasterBlaster or ByteBlasterMV
10-Pin Male Header
TDI
TDO
VCC
Pin 1
nSTATUS
nCONFIG
MSEL2
MSEL1
nCE
VCC
CONF_DONE
VCC
TMS
TCK
TDI
TDO
nCONFIG
MSEL2
MSEL1
nCE
VCC
CONF_DONE
VCC
TMS
TCK
TDI
TDO
nCONFIG
MSEL2
MSEL1
nCE
VCC
CONF_DONE
VCC
1 k
Ω
(3)
MSEL0
(3)
MSEL0
(3)
DCLK
(3)
DATA0
(3)
MSEL0
(3)
VIO
(4)
Stratix Device
1 k
Ω
nSTATUS
10 k
Ω
10 k
Ω
10 k
Ω
10 k
Ω
10 k
Ω
10 k
Ω
(5)
1 k
Ω
相關(guān)PDF資料 |
PDF描述 |
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